JTAG/ I2
參數(shù)資料
型號: IDT5T9890NLI8
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 36/37頁
文件大小: 0K
描述: IC CLK DRIVER 2.5V PLL 68-VFQFPN
產(chǎn)品變化通告: Product Discontinuation 05/Jan/2011
標準包裝: 2,500
類型: PLL 時鐘驅(qū)動器
PLL: 帶旁路
輸入: eHSTL,HSTL,LVPECL,LVTTL
輸出: eHSTL,HSTL,LVTTL
電路數(shù): 1
比率 - 輸入:輸出: 2:10
差分 - 輸入:輸出: 是/無
頻率 - 最大: 250MHz
除法器/乘法器: 是/無
電源電壓: 2.3 V ~ 2.7 V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 68-VFQFN 裸露焊盤
供應(yīng)商設(shè)備封裝: 68-VFQFPN(10x10)
包裝: 帶卷 (TR)
其它名稱: 5T9890NLI8
8
INDUSTRIALTEMPERATURERANGE
IDT5T9890
EEPROM PROGRAMMABLE 2.5V PROGRAMMABLE SKEW PLL CLOCK DRIVER
JTAG/ I2C SERIAL CONFIGURATIONS: SKEW OR FREQUENCY SELECT(1)
Bit 4, 9, 14,
Bit 3, 8, 13,
Bit 2, 7, 12,
Bit 1, 6, 11,
Bit 0, 5, 10,
Output Skew
19, 24, 29
18, 23, 28
17, 22, 27
16, 21, 26
15, 20, 25
0
1
+7tu
0
1
0
+6tu
0
1
+5tu
0
1
0
+4tu
0
1
0
1
+3tu
0
1
0
+2tu
0
1
+1tu
0
Zero Skew
01
0
1
-1tu
01
0
1
0
-2tu
01
0
1
-3tu
01
1
0
-4tu
01
1
0
1
-5tu
01
1
0
-6tu
01
1
-7tu
1
0
Inverted
1
0
1
Divide-by-2
1
0
1
0
Divide-by-4
NOTE
:
1. All other states that are undefined in the table will result in zero skew.
JTAG/ I2C SERIAL CONFIGURATIONS: FB DIVIDE-BY-N(1)
Bit 51
Bit 50
Bit 49
Bit 48
Divide-by-N
Permitted Output Divide-by-N connected to FB and FB/VREF2 (2)
0
1
1, 2, 4
0
1
2
1, 2
00
1
0
3
1
0
1
4
1, 2
0
1
0
5
1, 2
0
1
0
1
6
1, 2
01
1
0
8
1
01
1
10
1
10
0
12
1
NOTES:
1. All other states that are undefined in the table will be reserved.
2. Permissible output division ratios connected to FB and FB/VREF2. The frequencies of the REF[1:0] and REF [1:0]/VREF[1:0] inputs will be Fvco/N when the parts are
configured for frequency multiplication by using an undivided output for FB and FB/VREF2 and setting N (N = 1-6, 8, 10, 12).
JTAG/ I2C SERIAL CONFIGURATIONS:
VCO FREQUENCY SELECT
Bit 60
Min.
Max.
0
50Mhz
125MHz
1
100MHz
250Mhz
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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