PIN DESCRIPTION Symbol I/O Type Description A I
參數(shù)資料
型號(hào)： IDT5T915PAGI
廠(chǎng)商： IDT, Integrated Device Technology Inc
文件頁(yè)數(shù)： 15/21頁(yè)
文件大小： 0K
描述： IC CLK BUFF 1:5 250MHZ 48-TSSOP
標(biāo)準(zhǔn)包裝： 39
類(lèi)型： 扇出緩沖器（分配）
電路數(shù)： 1
比率 - 輸入:輸出： 1:5
差分 - 輸入:輸出： 是/是
輸入： eHSTL，HSTL，LVPECL，LVTTL
輸出： eHSTL，HSTL，LVTTL
頻率 - 最大： 250MHz
電源電壓： 2.4 V ~ 2.6 V
工作溫度： -40°C ~ 85°C
安裝類(lèi)型： 表面貼裝
封裝/外殼： 48-TFSOP（0.240"，6.10mm 寬）
供應(yīng)商設(shè)備封裝： 48-TSSOP
包裝： 管件
其它名稱(chēng)： 5T915PAGI
INDUSTRIALTEMPERATURERANGE
IDT5T915
2.5VDIFFERENTIAL1:5CLOCKBUFFERTERABUFFER
3
PIN DESCRIPTION
Symbol
I/O
Type
Description
A
I
Adjustable(1)
Clock input. A is the "true" side of the differential clock input. If operating in single-ended mode, A is the clock input.
A
/VREF
I
Adjustable(1)
Complementary clock input. A/VREF is the "complementary" side of A if the input is in differential mode. If operating in single-ended
mode, A/VREF is connected to GND. For single-ended operation in differential mode, A/VREF should be set to the desired toggle
voltage for A:
2.5VLVTTL
VREF = 1250mV
1.8V LVTTL, eHSTL
VREF = 900mV
HSTL
VREF = 750mV
LVEPECL
VREF = 1082mV
G(+)
I
LVTTL(5)
Gate control for "true", Qn, outputs. When G(+) is LOW, the "true" outputs are enabled. When G(+) is HIGH, the "true" outputs are
asynchronously disabled to the level designated by GL(4).
G(-)
I
LVTTL(5)
Gate control for "complementary", Qn, outputs. When G(-) is LOW, the "complementary" outputs are enabled. When G(-) is HIGH,
the"complementary"outputsareasynchronouslydisabledtotheoppositelevelasGL(4).
GL
I
LVTTL(5)
Specifies output disable level. If HIGH, "true" outputs disable HIGH and "complementary" outputs disable LOW. If LOW, "true"
outputsdisableLOWand"complementary"outputsdisableHIGH.
Qn
O
Adjustable(2)
Clockoutputs
Qn
O
Adjustable(2)
Complementaryclockoutputs
RxS
I
3 Level(3)
Selects single-ended 2.5V LVTTL (HIGH), 1.8V LVTTL (MID) clock input or differential (LOW) clock input
TxS
I
3 Level(3)
Sets the drive strength of the output drivers to be 2.5V LVTTL (HIGH), 1.8V LVTTL (MID) or HSTL (LOW) compatible. Used in
conjuction with VDDQtosettheinterfacelevels.
VDD
PWR
Power supply for the device core and inputs
VDDQ
PWR
Power supply for the device outputs. When utilizing 2.5V LVTTL outputs, VDDQ should be connected to VDD.
GND
PWR
Power supply return for all power
NOTES:
1. Inputs are capable of translating the following interface standards. User can select between:
Single-ended 2.5V LVTTL levels
Single-ended 1.8V LVTTL levels
or
Differential 2.5V/1.8V LVTTL levels
Differential HSTL and eHSTL levels
Differential LVEPECL levels
2. Outputs are user selectable to drive 2.5V, 1.8V LVTTL, eHSTL, or HSTL interface levels when used with the appropriate VDDQ voltage.
3. 3-level inputs are static inputs and must be tied to VDD or GND or left floating. These inputs are not hot-insertable or over voltage tolerant.
4. Because the gate controls are asynchronous, runt pulses are possible. It is the user's responsibility to either time the gate control signals to minimize the possibility of runt
pulses or be able to tolerate them in down stream circuitry.
5. Pins listed as LVTTL inputs will accept 2.5V signals when RxS = HIGH or 1.8V signals when RxS = LOW or MID.
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PDF描述
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參數(shù)描述
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IDT5T929-10NLGI 功能描述:IC CLOCK GENERATOR PREC 28VFQFPN RoHS:是 類(lèi)別:集成電路 (IC) >> 時(shí)鐘/計(jì)時(shí) - 專(zhuān)用 系列:- 標(biāo)準(zhǔn)包裝:1,500 系列:- 類(lèi)型:時(shí)鐘緩沖器/驅(qū)動(dòng)器 PLL:是 主要目的:- 輸入:- 輸出:- 電路數(shù):- 比率 - 輸入:輸出:- 差分 - 輸入:輸出:- 頻率 - 最大:- 電源電壓:3.3V 工作溫度:0°C ~ 70°C 安裝類(lèi)型:表面貼裝 封裝/外殼:28-SSOP（0.209"，5.30mm 寬） 供應(yīng)商設(shè)備封裝:28-SSOP 包裝:帶卷 (TR) 其它名稱(chēng):93786AFT
IDT5T929-10NLGI8 功能描述:IC CLOCK GENERATOR PREC 28VFQFPN RoHS:是 類(lèi)別:集成電路 (IC) >> 時(shí)鐘/計(jì)時(shí) - 專(zhuān)用 系列:- 標(biāo)準(zhǔn)包裝:1,500 系列:- 類(lèi)型:時(shí)鐘緩沖器/驅(qū)動(dòng)器 PLL:是 主要目的:- 輸入:- 輸出:- 電路數(shù):- 比率 - 輸入:輸出:- 差分 - 輸入:輸出:- 頻率 - 最大:- 電源電壓:3.3V 工作溫度:0°C ~ 70°C 安裝類(lèi)型:表面貼裝 封裝/外殼:28-SSOP（0.209"，5.30mm 寬） 供應(yīng)商設(shè)備封裝:28-SSOP 包裝:帶卷 (TR) 其它名稱(chēng):93786AFT
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