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參數資料
| 型號： | IDT49FCT3805APYG8 |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數： | 5/7頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLK BUFFER 1:5 100MHZ 20-SSOP |
| 產品培訓模塊： | Clock Distibution and Generation 1.0 |
| 標準包裝： | 1 |
| 系列： | 49FCT |
| 類型： | 扇出緩沖器（分配） |
| 電路數： | 2 |
| 比率 - 輸入:輸出： | 1:5 |
| 差分 - 輸入:輸出： | 無/無 |
| 輸入： | LVTTL |
| 輸出： | CMOS，LVTTL |
| 頻率 - 最大： | 100MHz |
| 電源電壓： | 3 V ~ 3.6 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 20-SSOP（0.209"，5.30mm 寬） |
| 供應商設備封裝： | 20-SSOP |
| 包裝： | 標準包裝 |
| 產品目錄頁面： | 1253 (CN2011-ZH PDF) |
| 其它名稱： | 800-1337-6 |
5
IDT49FCT805/A
FAST CMOSBUFFER/CLOCKDRIVER
COMMERCIALANDINDUSTRIALTEMPERATURERANGE
NOTES:
1. Propagation delay range indicated by Min. and Max. limit is due to VCC, operating temperature and process parameters. These propagation delay limits do not imply skew.
2. See test circuits and waveforms.
SWITCHING CHARACTERISTICS OVER OPERATING RANGE(1)
FCT805
FCT805A
Symbol
Parameter
Conditions(2)
Min.
Max.
Min.
Max.
Unit
tPLH
PropagationDelay
CL = 50pF
1.5
5.6
1.5
5.3
ns
tPHL
INA to OAn, INB to OBn
RL = 500
tR
OutputRiseTime
—
1.5
—
1.5
ns
tF
OutputFallTime
—
1.5
—
1.5
ns
tSK(O)
Output skew: skew between outputs of all banks of
—
0.7
—
0.7
ns
samepackage(inputstiedtogether)
tSK(P)
Pulseskew:skewbetweenoppositetransitions
—
1
—
1
ns
ofsameoutput(|tPHL-–tPLH|)
tSK(PP)
Part-to-partskew:skewbetweenoutputsofdifferent
—
1.5
—
1.5
ns
packages at same power supply voltage,
temperature,packagetypeandspeedgrade
tPZL
OutputEnableTime
1.5
8
1.5
8
ns
tPZH
OE
A
to OAn, OEB to OBn
tPLZ
OutputDisableTime
1.5
7
1.5
7
ns
tPHZ
OE
A
to OAn, OEB to OBn
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