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參數(shù)資料
| 型號(hào)： | ICSSSTU32864 |
| 英文描述： | 25-Bit Configurable Registered Buffer |
| 中文描述： | 25位可配置注冊(cè)緩沖區(qū) |
| 文件頁數(shù)： | 1/11頁 |
| 文件大小： | 110K |
| 代理商： | ICSSSTU32864 |
Integrated
Circuit
Systems, Inc.
ICSSSTU32864
0727C—04/15/04
Recommended Application:
DDR2 Memory Modules
Provides complete DDR DIMM logic solution with
ICS97U877
Product Features:
25-bit 1:1 or 14-bit 1:2 configurable registered buffer
Supports SSTL_18 JEDEC specification on data
inputs and outputs
Supports LVCMOS switching levels on CSR# and
RESET# inputs
Low voltage operation
V
DD
= 1.7V to 1.9V
Available in 96 BGA package
25-Bit Configurable Registered Buffer
Truth Table
Pin Configuration
96 Ball BGA
(Top View)
Ball Assignments
A
B
1
2
3
4
5
6
C
D
E
F
G
H
J
K
L
M
N
P
R
T
A
B
C
D
E
F
G
H
J
K
L
M
N
P
R
T
DCKE
NC
V
REF
V
DD
QCKE
NC
D2
D15
GND
GND
Q2
Q15
D3
D16
V
DD
V
DD
Q3
Q16
DODT
NC
GND
GND
QODT
NC
D5
D17
V
DD
V
DD
Q5
Q17
D6
D18
GND
GND
Q6
Q18
NC
RST#
V
DD
V
DD
C1
C0
CK
DCS#
GND
GND
QCS#
NC
CK#
CSR#
V
DD
V
DD
ZOH
ZOL
D8
D19
GND
GND
Q8
Q19
D9
D20
V
DD
V
DD
Q9
Q20
D10
D21
GND
GND
Q10
Q21
D11
D22
V
DD
V
DD
Q11
Q22
D12
D23
GND
GND
Q12
Q23
D13
D24
V
DD
V
DD
Q13
Q24
D14
D25
V
REF
V
DD
Q14
Q25
1
2
3
4
5
6
1:1 Register (C0 = 0, C1 = 0)
Inputs
Outputs
RST#
DCS#
CSR#
CK
CK#
Dn,
DODT,
DCKE
Qn
QCS#
QODT,
QCKE
H
L
L
L
L
L
L
H
L
L
L
L
H
H
Q
0
L
L
Q
0
H
Q
0
L
H
L or H
L or H
X
H
L
H
L
L
H
L
L
H
H
H
H
Q
0
L
L
Q
0
H
Q
0
L
H
L or H
L or H
X
H
H
L
L
H
H
H
H
L
L
H
H
Q
0
Q
0
Q
0
Q
0
H
Q
0
H
H
Q
0
L
H
L or H
L or H
X
H
H
H
L
H
H
H
H
H
H
H
H
Q
0
H
L or H
X or
Floating
L or H
X or
Floating
X
Q
0
L
X or
Floating
X or
Floating
X or
Floating
L
L
L
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PDF描述 |
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