參數(shù)資料
型號(hào): ICS97U2A877A
英文描述: 1.8V Low-Power Wide-Range Frequency Clock Driver
中文描述: 1.8V的低功耗寬范圍頻率時(shí)鐘驅(qū)動(dòng)器
文件頁數(shù): 7/14頁
文件大?。?/td> 187K
代理商: ICS97U2A877A
7
ICS97U2A877A
Advance Information
1180—11/14/05
Notes:
1.
2.
Switching characteristics guaranteed for application frequency range.
Static phase offset shifted by design.
Switching Characteristics
1
T
A
= 0 - 70°C Supply Voltage AVDD, VDDQ = 1.8 V +/- 0.1V (unless otherwise stated)
PARAMETER
SYMBOL
Output enable time
t
en
Output disable time
t
dis
CONDITION
(MHz)
MIN
TYP
4.73
5.82
MAX
8
8
40
30
60
50
4
UNITS
ns
ns
ps
ps
ps
ps
v/ns
v/ns
v/ns
ps
ps
ps
ps
ps
ps
ps
ps
ps
kHz
OE to any output
OE to any output
160 to 270
271 to 410
160 to 270
271 to 410
-40
-30
-60
-50
1
0.5
1.5
0
0
-50
-20
-50
Input Clock
Output Enable (OE), (OS)
2.5
Output clock slew rate
SLr1(o)
t
jit(cc+)
t
jit(cc-)
2.5
3
40
-40
50
20
50
80
60
40
30
33
160 to 270
271 to 410
271 to 410
Static Phase Offset
t
jit
(per)
+
t
()dyn +
t
skew(o)
t
()dyn
+
t
skew(o)
t
SPO
(su)
t
(h)
2
0
160 to 270
271 to 410
SSC modulation frequency
SSC clock input frequency
deviation
PLL Loop bandwidth (-3 dB
from unity gain)
30.00
0.00
-0.50
%
2.0
MHz
Output to Output Skew
t
skew
160 to 410
Period jitter
t
jit (per)
Input slew rate
SLr1(i)
160 to 410
Cycle-to-cycle period jitter
Dynamic Phase Offset
t
()dyn
Half-period jitter
t
jit(hper)
相關(guān)PDF資料
PDF描述
ICS97U2A877AH(LF)-T 1.8V Low-Power Wide-Range Frequency Clock Driver
ICS97U2A877AK(LF)-T 1.8V Low-Power Wide-Range Frequency Clock Driver
ICS97U877AHLF 1.8V Wide Range Frequency Clock Driver
ICS97U877AKLF 1.8V Wide Range Frequency Clock Driver
ICS97U877yH-T 1.8V Wide Range Frequency Clock Driver
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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