參數(shù)資料
型號： ICS954201
英文描述： 16-Bit Registered Transceivers With 3-State Outputs 56-TSSOP -40 to 85
中文描述： 可編程定時控制中心，對移動P4⑩⑩系統(tǒng)
文件頁數(shù)： 2/15頁
文件大?。?/td> 157K
代理商： ICS954201
2
Integrated
Circuit
Systems, Inc.
ICS954201
0819G—12/06/04
Pin Description
PIN # PIN NAME
PIN
TYPE
PWR
PWR
OUT
OUT
OUT
PWR
PWR
DESCRIPTION
1
2
3
4
5
6
7
VDDPCI
GND
PCICLK3
PCICLK4
PCICLK5
GND
VDDPCI
Power supply for PCI clocks, nominal 3.3V
Ground pin.
PCI clock output.
PCI clock output.
PCI clock output.
Ground pin.
Power supply for PCI clocks, nominal 3.3V
Free running PCI clock not affected by PCI_STOP#.
ITP_EN: latched input to select pin functionality
1 = CPU_ITP pair
0 = SRC pair
Free running PCI clock not affected by PCI_STOP# .
Vtt_PwrGd# is an active low input used to determine when
latched inputs are ready to be sampled. PD is an asynchronous
active high input pin used to put the device into a low power
state. The internal clocks, PLLs and the crystal oscillator are
stopped.
Power pin for the 48MHz output.3.3V
Frequency select latch input pin / Fixed 48MHz USB clock
output. 3.3V.
Ground pin.
True clock of differential pair for 96.00MHz DOT clock.
8
ITP_EN/PCICLK_F0
I/O
9
PCICLK_F1
OUT
10
Vtt_PwrGd#/PD
IN
11
VDD48
PWR
12
USB_48MHz/FS_A
I/O
13
14
GND
DOTT_96MHz
PWR
OUT
15
DOTC_96MHz
OUT
Complement clock of differential pair for 96.00MHz DOT clock.
16
FS_B/TEST_MODE
IN
3.3V tolerant input for CPU frequency selection. Refer to input
electrical characteristics for Vil_FS and Vih_FS values.
TEST_MODE is a real time input to select between Hi-Z and
REF/N divider mode while in test mode. Refer to Test
Clarification Table.
True clock of differential SRC clock pair.
Complement clock of differential SRC clock pair.
True clock of differential SRC clock pair.
Complement clock of differential SRC clock pair.
Supply for SRC clocks, 3.3V nominal
True clock of differential SRC clock pair.
Complement clock of differential SRC clock pair.
True clock of differential SRC clock pair.
Complement clock of differential SRC clock pair.
True clock of differential SRC/SATA pair.
Complement clock of differential SRC/SATA pair.
Supply for SRC clocks, 3.3V nominal
17
18
19
20
21
22
23
24
25
26
27
28
SRCCLKT0
SRCCLKC0
SRCCLKT1
SRCCLKC1
VDDSRC
SRCCLKT2
SRCCLKC2
SRCCLKT3
SRCCLKC3
SRCCLKT4_SATA
SRCCLKC4_SATA
VDDSRC
OUT
OUT
OUT
OUT
PWR
OUT
OUT
OUT
OUT
OUT
OUT
PWR
相關(guān)PDF資料
PDF描述
ICS954204 16-Bit Registered Transceivers With 3-State Outputs 56-SSOP -40 to 85
ICS95420YGLFT Filter Module
ICS95420YGLNT Filter Module with Resistor Network
ICS95V842I DDR Phase Lock Loop Clock Driver (60MHz - 220MHz)
ICS95V842yFILF-T DDR Phase Lock Loop Clock Driver (60MHz - 220MHz)
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
ICS954201BF 功能描述:IC TIMING CTRL HUB P4 56-SSOP RoHS:否 類別:集成電路 (IC) >> 時鐘/計時 - 專用 系列:TCH™, PCI Express® (PCIe) 標(biāo)準(zhǔn)包裝:1,500 系列:- 類型:時鐘緩沖器/驅(qū)動器 PLL:是 主要目的:- 輸入:- 輸出:- 電路數(shù):- 比率 - 輸入:輸出:- 差分 - 輸入:輸出:- 頻率 - 最大:- 電源電壓:3.3V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:28-SSOP（0.209"，5.30mm 寬） 供應(yīng)商設(shè)備封裝:28-SSOP 包裝:帶卷 (TR) 其它名稱:93786AFT
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