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參數(shù)資料
| 型號： | ICS932S431AGLFT |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 8/22頁 |
| 文件大小： | 0K |
| 描述： | IC CLOCK CHIP 56-TSSOP |
| 標準包裝： | 1,000 |
| 類型： | 時鐘/頻率合成器 |
| PLL： | 是 |
| 主要目的： | Intel CPU 服務器 |
| 輸入： | 晶體 |
| 輸出： | HCSL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:19 |
| 差分 - 輸入:輸出： | 無/是 |
| 頻率 - 最大： | 400MHz |
| 電源電壓： | 3.135 V ~ 3.465 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 56-TFSOP（0.240"，6.10mm 寬） |
| 供應商設備封裝： | 56-TSSOP |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | 932S431AGLFT |
16
Integrated
Circuit
Systems, Inc.
ICS932S431A
Datasheet
1426A—11/12/09
SMBus Table: SRC/PCI Frequency Control Register
Pin #
Name
Control Function
Type
0
1
PWD
Bit 7
SRC N Div8
N Divider Prog bit 8
RW
X
Bit 6
SRC N Div9
N Divider Prog bit 9
RW
X
Bit 5
SRC M Div5
RW
X
Bit 4
SRC M Div4
RW
X
Bit 3
SRC M Div3
RW
X
Bit 2
SRC M Div2
RW
X
Bit 1
SRC M Div1
RW
X
Bit 0
SRC M Div0
RW
X
SMBus Table: SRC/PCI Frequency Control Register
Pin #
Name
Control Function
Type
0
1
PWD
Bit 7
SRC N Div7
RW
X
Bit 6
SRC N Div6
RW
X
Bit 5
SRC N Div5
RW
X
Bit 4
SRC N Div4
RW
X
Bit 3
SRC N Div3
RW
X
Bit 2
SRC N Div2
RW
X
Bit 1
SRC N Div1
RW
X
Bit 0
SRC N Div0
RW
X
SMBus Table: SRC/PCI Spread Spectrum Control Register
Pin #
Name
Control Function
Type
0
1
PWD
Bit 7
X
Bit 6
X
Bit 5
X
Bit 4
X
Bit 3
X
Bit 2
X
Bit 1
X
Bit 0
X
SMBus Table: SRC/PCI Spread Spectrum Control Register
Pin #
Name
Control Function
Type
0
1
PWD
Bit 7
X
Bit 6
X
Bit 5
X
Bit 4
X
Bit 3
X
Bit 2
X
Bit 1
X
Bit 0
X
RESERVED
Byte 18
Byte 16
-
RESERVED
The decimal representation of
M and N Divider in Byte 15 and
16 will configure the SRC VCO
frequency. Default at power up
= latch-in or Byte 0 Rom table.
VCO Frequency = 14.318 x
[NDiv(9:0)+8] / [MDiv(5:0)+2]
M Divider Programming
bits
RESERVED
-
Byte 17
-
N Divider Programming
b(7:0)
The decimal representation of
M and N Divider in Byte 15 and
16 will configure the SRC VCO
frequency. Default at power up
= latch-in or Byte 0 Rom table.
VCO Frequency = 14.318 x
[NDiv(9:0)+8] / [MDiv(5:0)+2]
-
Byte 15
相關PDF資料 |
PDF描述 |
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