參數(shù)資料
型號(hào)： ICS9170B-01CS08LFT
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 5/12頁
文件大?。?/td> 0K
描述： IC CLK SYNTHESIZER/MULT 8SOIC
標(biāo)準(zhǔn)包裝： 2,500
類型： 時(shí)鐘同步器，扇出配送，零延遲緩沖器
PLL： 是
輸入： 時(shí)鐘
輸出： 時(shí)鐘
電路數(shù)： 1
比率 - 輸入:輸出： 1:2
差分 - 輸入:輸出： 無/無
頻率 - 最大： 107MHz
除法器/乘法器： 是/是
電源電壓： 3.135 V ~ 5.25 V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 8-SOIC（0.154"，3.90mm 寬）
供應(yīng)商設(shè)備封裝： 8-SOIC
包裝： 帶卷 (TR)
IDT9170B
CLOCK SYNCHRONIZER AND MULTIPLIER
CLOCK SYNTHESIZER
IDT CLOCK SYNCHRONIZER AND MULTIPLIER
2
IDT9170B
REV B 052609
Pin Assignment
Pin Descriptions
Using the IDT9170B
The IDT9170B has the following characteristics:
1. Rising edges at IN and FBIN are lined up. Falling edges
are not synchronized.
2. The relationship between the frequencies at FBIN and IN
with CLK1 feedback is shown in Table 1 below.
Functionality (Table 1)
3. The frequency of CLK2 is half the CLK1 frequency.
4. The CLK1 frequency ranges are:
Eliminate High Speed Clock Routing Problems
The IDT9170B makes it possible to route lower speed clocks
over long distances on the PC board and to place an
IDT9170B next to the device requiring a higher speed clock.
The multiplied output can then be used to produce a phase
locked, higher speed output clock.
Compensate for Propagation Delays
Including an IDT9170B in a timing loop allows the use of
PALs, gate arrays, etc., with loose timing specifications. The
IDT9170B compensates for the delay through the PAL and
synchronizes the output to the input reference clock.
FBI N
IN
GN D
VDD
FS 0
CL K 1
FS 1
CL K 2
1
2
3
4
8
7
6
5
Pin
Number
Pin
Name
Pin
Type
Pin Description
1
FBIN
Input
Feedback input.
2
IN
Input
Input for reference clock.
3
GND
Power
Connect to ground.
4
FS0
Input
Frequency select 0.
5
FS1
Input
Frequency select 1.
6
CLK1
Output
Clock output 1. See tables 1, 2 for values.
7
VDD
Power
Power supply.
8
CLK2
Output
Clock output 2. See tables 1, 2 for values.
FS1 FS0
fFBIN (-01, -02)
0
2 * fIN
01
4 * fIN
10
fIN
11
8 * fIN
VDD=5 V
VDD=3.3 V
IDT9170B-01
20 < fCLK1
<107 MHz
<66.7
IDT9170B-02
5 < fCLK1
<26.75 MHz
<16.7
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PDF描述
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參數(shù)描述
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