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參數(shù)資料
| 型號(hào)： | ICS87946AYILF |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 7/11頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLK GEN LVCMOS /1 /2 32-LQFP |
| 標(biāo)準(zhǔn)包裝： | 250 |
| 系列： | HiPerClockS™ |
| 類型： | 時(shí)鐘發(fā)生器 |
| PLL： | 無 |
| 輸入： | LVCMOS，LVTTL |
| 輸出： | LVCMOS |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:10 |
| 差分 - 輸入:輸出： | 無/無 |
| 頻率 - 最大： | 150MHz |
| 除法器/乘法器： | 是/無 |
| 電源電壓： | 3 V ~ 3.6 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 32-LQFP |
| 供應(yīng)商設(shè)備封裝： | 32-TQFP（7x7） |
| 包裝： | 托盤 |
| 產(chǎn)品目錄頁面： | 1250 (CN2011-ZH PDF) |
| 其它名稱： | 800-1224 87946AYILF |
ICS87946AYI REVISION B JUNE 22, 2012
5
2012 Integrated Device Technology, Inc.
ICS87946I Data Sheet
LOW SKEW, ÷1, ÷2 LVCMOS/LVTTL CLOCK GENERATOR
AC Electrical Characteristics
Table 5. AC Characteristics, VDD = VDDX = 3.3V ± 0.3V, TA = -40°C to 85°C
NOTE: Electrical parameters are guaranteed over the specified ambient operating temperature range, which is established when the device is
mounted in a test socket with maintained transverse airflow greater than 500 lfpm. The device will meet specifications after thermal equilibrium
has been reached under these conditions.
NOTE: VDDX denotes VDDA, VDDB, VDDC.
NOTE 1: Measured from VDD/2 of the input to VDDX/2 of the output.
NOTE 2: Defined as skew between outputs at the same supply voltage and with equal load conditions. Measured at VDDX/2.
NOTE 3: Defined as skew across banks of outputs operating at different frequencies with the same supply voltage and equal load conditions.
NOTE 4: Defined as skew between outputs on different devices operating at the same supply voltage, same frequency and with equal load
conditions. Using the same type of inputs on each device, the outputs are measured at VDDX/2.
NOTE 5: These parameters are guaranteed by characterization. Not tested in production.
NOTE 6: This parameter is defined in accordance with JEDEC Standard 65.
Symbol
Parameter
Test Conditions
Minimum
Typical
Maximum
Units
fIN
Input Frequency
150
MHz
tpLH
Propagation Delay
Low to High; NOTE 1
212
ns
tpHL
Propagation Delay
High to Low; NOTE 1
2.0
11.5
ns
tsk(o)
Output Skew; NOTE 2, 6
350
ps
tsk(w)
Multiple Frequency Skew;
NOTE 3, 6
fMAX < 100MHz
350
ps
fMAX > 100MHz
450
ps
tsk(pp)
Part-to-Part Skew;
NOTE 4, 6
4.5
ns
tR / tF
Output Rise/Fall Time;
NOTE 5
0.8V to 2.0V
0.1
1.0
ns
tEN
Output Enable Time;
NOTE 5
11
ns
tDIS
Output Disable Time;
NOTE 5
11
ns
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