參數(shù)資料
型號(hào)： ICS87421AMILFT
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 1/14頁
文件大?。?/td> 0K
描述： IC CLOCK GEN LVDS 8-SOIC
標(biāo)準(zhǔn)包裝： 2,500
系列： HiPerClockS™
類型： 時(shí)鐘發(fā)生器
PLL： 無
輸入： HCSL，LVDS，LVHSTL，LVPECL，SSTL
輸出： LVDS
電路數(shù)： 1
比率 - 輸入:輸出： 1:1
差分 - 輸入:輸出： 是/是
頻率 - 最大： 1GHz
除法器/乘法器： 是/無
電源電壓： 3.135 V ~ 3.465 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 8-SOIC（0.154"，3.90mm 寬）
供應(yīng)商設(shè)備封裝： 8-SOIC
包裝： 帶卷 (TR)
其它名稱： 87421AMILFT
÷1/÷2 DIFFERENTIAL-TO-LVDS
CLOCK GENERATOR
ICS87421I
IDT / ICS LVDS CLOCK GENERATOR
1
ICS87421AMI REV. A OCTOBER 3, 2007
GENERAL DESCRIPTION
The ICS87421I is a high perfor mance ÷1/÷2
Differential-to-LVDS Clock Generator and a mem-
ber of the HiPerClockS family of High Perfor-
mance Clock Solutions from IDT. The CLK, nCLK
pair can accept most standard differential input
levels. The ICS87421I is characterized to operate from a 3.3V
power supply. Guaranteed part-to-part skew characteristics
make the ICS87421I ideal for those clock distribution applica-
tions demanding well defined performance and repeatability.
FEATURES
One differential LVDS output
One differential CLK, nCLK input pair
CLK, nCLK pair can accept the following differential input
levels: LVPECL, LVDS, LVHSTL, SSTL, HCSL
Maximum clock input frequency: 1GHz
Translates any single ended input signal (LVCMOS, LVTTL,
GTL) to LVDS levels with resistor bias on nCLK input
Part-to-part skew: 500ps (maximum)
Propagation delay: 1.7ns (maximum)
Additive phase jitter, RMS @ 155.52MHz: 0.17ps (typical)
Full 3.3V operating supply
-40°C to 85°C ambient operating temperature
Available in both standard (RoHS 5) and lead-free (RoHS 6)
packages
BLOCK DIAGRAM
PIN ASSIGNMENT
ICS87421I
8-Lead SOIC
3.90mm x 4.90mm x 1.37mm package body
M Package
Top View
CLK
nCLK
MR
F_SEL
1
2
3
4
HiPerClockS
ICS
VDD
Q
nQ
GND
8
7
6
5
Q
nQ
CLK
nCLK
MR
F_SEL
0
1
÷1
÷2
R
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PDF描述
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參數(shù)描述
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