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參數(shù)資料
| 型號： | ICS8735AY-31LFT |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 21/21頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLK GEN ZD 1:5 LVPECL 32-LQFP |
| 標(biāo)準(zhǔn)包裝： | 1,000 |
| 系列： | HiPerClockS™ |
| 類型： | 時(shí)鐘發(fā)生器 |
| PLL： | 帶旁路 |
| 輸入： | HCSL，LVDS，LVHSTL，LVPECL，SSTL |
| 輸出： | LVPECL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:5 |
| 差分 - 輸入:輸出： | 是/是 |
| 頻率 - 最大： | 350MHz |
| 除法器/乘法器： | 是/是 |
| 電源電壓： | 3.135 V ~ 3.465 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 32-LQFP |
| 供應(yīng)商設(shè)備封裝： | 32-TQFP（7x7） |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | 8735AY-31LFT |
ICS8735-31
1:5, DIFFERENTIAL-TO-3.3V LVPECL ZERO DELAY CLOCK GENERATOR
IDT / ICS 3.3V LVPECL ZERO DELAY CLOCK GENERATOR
9
ICS8735AY-31 REV. B FEBRUARY 18, 2009
Parameter Measurement Information, continued
Output Duty Cycle/Pulse Width/Period
Propagation Delay
Application Information
Recommendations for Unused Input and Output Pins
Inputs:
LVCMOS Control Pins
All control pins have internal pullups or pulldowns; additional
resistance is not required but can be added for additional
protection. A 1k
resistor can be used.
CLK/nCLK Inputs
For applications not requiring the use of the differential input, both
CLK and nCLK can be left floating. Though not required, but for
additional protection, a 1k
resistor can be tied from CLK to
ground.
FB_IN/nFB_IN Inputs
For applications not requiring the use of the differential input, both
FB_IN and nFB_IN can be left floating. Though not required, but for
additional protection, a 1k
resistor can be tied from FB_IN to
ground.
Outputs:
LVPECL Outputs
All unused LVPECL outputs can be left floating. We recommend
that there is no trace attached. Both sides of the differential output
pair should either be left floating or terminated.
t
PW
t
PERIOD
t
PW
t
PERIOD
odc =
x 100%
nQ[0:4]
Q[0:4]
t
PD
nQ[0:4]
Q[0:4]
nCLK0,
nCLK1
CLK0,
CLK1
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PDF描述 |
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參數(shù)描述 |
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