參數(shù)資料
型號(hào)： ICS854105AGLFT
廠商： IDT, Integrated Device Technology Inc
文件頁(yè)數(shù)： 5/12頁(yè)
文件大小： 0K
描述： IC CLK BUFF 1:4 250MHZ 16-TSSOP
標(biāo)準(zhǔn)包裝： 2,500
系列： HiPerClockS™
類型： 扇出緩沖器（分配）
電路數(shù)： 1
比率 - 輸入:輸出： 1:4
差分 - 輸入:輸出： 無(wú)/是
輸入： LVCMOS，LVTTL
輸出： LVDS
頻率 - 最大： 250MHz
電源電壓： 3.135 V ~ 3.465 V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 16-TSSOP（0.173"，4.40mm 寬）
供應(yīng)商設(shè)備封裝： 16-TSSOP
包裝： 帶卷 (TR)
其它名稱： 854105AGLFT
ICS854105 Data Sheet
LOW SKEW, 1-TO-4, LVCMOS/LVTTL-TO-LVDS FANOUT BUFFER
ICS854105AG REVISION A FEBRUARY 23, 2010
2
2010 Integrated Device Technology, Inc.
Table 1. Pin Descriptions
NOTE: Pullup and Pulldown refer to internal input resistors. See Table 2, Pin Characteristics, for typical values.
Table 2. Pin Characteristics
Function Table
Table 3. Output Enable Function Table
Number
Name
Type
Description
1
OE0
Input
Pullup
Output enable pin for Q0, nQ0 outputs. See Table 3. LVCMOS/LVTTL interface levels.
2
OE1
Input
Pullup
Output enable pin for Q1, nQ1 outputs. See Table 3. LVCMOS/LVTTL interface levels.
3
OE2
Input
Pullup
Output enable pin for Q2, nQ2 outputs. See Table 3. LVCMOS/LVTTL interface levels.
4VDD
Power
Positive supply pin.
5
GND
Power
Power supply ground.
6
CLK
Input
Pulldown
Single-ended clock input. LVCMOS/LVTTL interface levels.
7
nc
Unused
No connect.
8
OE3
Input
Pullup
Output enable pin for Q3, nQ3 outputs. See Table 3. LVCMOS/LVTTL interface levels.
9, 10
nQ3, Q3
Output
Differential output pair. LVDS interface levels.
11, 12
nQ2, Q2
Output
Differential output pair. LVDS interface levels.
13, 14
nQ1, Q1
Output
Differential output pair. LVDS interface levels.
15, 16
nQ0, Q0
Output
Differential output pair. LVDS interface levels.
Symbol
Parameter
Test Conditions
Minimum
Typical
Maximum
Units
CIN
Input Capacitance
4pF
RPULLUP
Input Pullup Resistor
51
k
RPULLDOWN
Input Pulldown Resistor
51
k
Inputs
Outputs
OE[3:0]
Q[3:0], nQ[3:0]
0
High-Impedance
1
Active (default)
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PDF描述
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參數(shù)描述
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