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參數(shù)資料
| 型號： | ICS8538BG-31LFT |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 8/14頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLOCK BUFFER MUX 2:8 28-TSSOP |
| 標準包裝： | 1,000 |
| 系列： | HiPerClockS™ |
| 類型： | 扇出緩沖器（分配），多路復用器 |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:8 |
| 差分 - 輸入:輸出： | 無/是 |
| 輸入： | LVCMOS，LVTTL，晶體 |
| 輸出： | LVPECL |
| 頻率 - 最大： | 266MHz |
| 電源電壓： | 3.135 V ~ 3.465 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 28-TSSOP（0.173"，4.40mm 寬） |
| 供應商設備封裝： | 28-TSSOP |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | 8538BG-31LFT |
ICS8538-31
LOW SKEW, 1-TO-8, CRYSTAL OSCILLATOR/LVCMOS-TO-3.3V LVPECL FANOUT BUFFER
IDT / ICS LVPECL FANOUT BUFFER
3
ICS8538BG-31 REV. B FEBRUARY 5, 2008
Function Tables
Table 3A. Control Input Function Table
After CLK_EN switches, the clock outputs are disabled or enabled following a rising and falling input clock or crystal oscillator edge as
shown in Figure 1. In the active mode, the state of the outputs are a function of the CLK input as described in Table 3B.
Figure 1. CLK_EN Timing Diagram
Table 3B. Clock Input Function Table
Inputs
Outputs
CLK_EN
CLK_SEL
Selected Source
Q0:Q7
nQ0:nQ7
0
CLK
Disabled; Low
Disabled; High
0
1
XTAL_IN, XTAL_OUT
Disabled; Low
Disabled; High
1
0
CLK
Enabled
1
XTAL_IN, XTAL_OUT
Enabled
Inputs
Outputs
CLK
Q0:Q7
nQ0:nQ7
0LOW
HIGH
1HIGH
LOW
Enabled
Disabled
CLK
CLK_EN
nQ0:nQ7
Q0:Q7
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