參數(shù)資料
型號： ICS85356AGILF
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 8/15頁
文件大小： 0K
描述： IC CLOCK MUX 2:1 900MHZ 20-TSSOP
標(biāo)準(zhǔn)包裝： 74
系列： HiPerClockS™
類型： 多路復(fù)用器
電路數(shù)： 2
比率 - 輸入:輸出： 2:1
差分 - 輸入:輸出： 是/是
輸入： HCSL，LVDS，LVHSTL，LVPECL，SSTL
輸出： LVPECL
頻率 - 最大： 900MHz
電源電壓： 3 V ~ 3.6 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 20-TSSOP（0.173"，4.40mm 寬）
供應(yīng)商設(shè)備封裝： 20-TSSOP
包裝： 管件
產(chǎn)品目錄頁面： 1250 (CN2011-ZH PDF)
其它名稱： 800-1175
800-1175-5
800-1175-ND
85356AGILF
ICS85356AMI REVISION B MAY 10, 2010
2
2010 Integrated Device Technology, Inc.
ICS85356I Data Sheet
2:1, DIFFERENTIAL-TO-3.3V LVPECL/ECL CLOCK MULTIPLEXER
Table 1. Pin Descriptions
NOTE: Pullup and Pulldown refer to internal input resistors. See Table 2, Pin Characteristics, for typical values.
Table 2. Pin Characteristics
Function Tables
Table 3. Control Input Function Table
Number
Name
Type
Description
14, 20
VCC
Power
Positive supply pins.
1
CLK0A
Input
Pulldown
Non-inverting differential clock input.
2
nCLK0A
Input
Pullup
Inverting differential clock input.
3, 8
nc
Unused
No connect.
4
CLK0B
Input
Pulldown
Non-inverting differential clock input.
5
nCLK0B
Input
Pullup
Inverting differential clock input.
6
CLK1A
Input
Pulldown
Non-inverting differential clock input.
7
nCLK1A
Input
Pullup
Inverting differential clock input.
9
CLK1B
Input
Pulldown
Non-inverting differential clock input.
10
nCLK1B
Input
Pullup
Inverting differential clock input.
11
VEE
Power
Negative supply pin.
12, 13
nQ1,Q1
Output
Differential output pair. LVPECL interface levels.
15, 17
SEL1, SEL0
Input
Pullup
Clock select inputs. LVCMOS/LVTTL interface levels.
16
COM_SEL
Input
Pulldown
Common select input. LVCMOS/LVTTL interface levels.
18, 19
nQ0,Q0
Output
Differential output pair. LVPECL interface levels.
Symbol
Parameter
Test Conditions
Minimum
Typical
Maximum
Units
CIN
Input Capacitance
4
pF
RPULLUP
Input Pullup Resistor
51
k
RPULLDOWN
Input Pulldown Resistor
51
k
Inputs
Outputs
COM_SEL
SEL1
SEL0
Q0
nQ0
Q1
nQ1
0
CLK0A
nCLK0A
CLK1A
nCLK1A
0
1
CLK0B
nCLK0B
CLK1A
nCLK1A
0
1
0
CLK0A
nCLK0A
CLK1B
nCLK1B
0
1
CLK0B
nCLK0B
CLK1B
nCLK1B
1
x
CLK0B
nCLK0B
CLK1B
nCLK1B
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PDF描述
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