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參數(shù)資料
| 型號： | ICS85311AMLFT |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 14/16頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLOCK BUFFER 1:2 1GHZ 8-SOIC |
| 標準包裝： | 2,500 |
| 系列： | HiPerClockS™ |
| 類型： | 扇出緩沖器（分配） |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:2 |
| 差分 - 輸入:輸出： | 是/是 |
| 輸入： | HCSL，LVDS，LVHSTL，LVPECL，SSTL |
| 輸出： | ECL，LVPECL |
| 頻率 - 最大： | 1GHz |
| 電源電壓： | 2.375 V ~ 3.465 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 8-SOIC（0.154"，3.90mm 寬） |
| 供應商設備封裝： | 8-SOIC |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | 85311AMLFT |
ICS85311
LOW SKEW, 1-TO-2, DIFFERENTIAL-TO-LVPECL/ECLFANOUT BUFFER
IDT / ICS LVPECL/ECL FANOUT BUFFER
7
ICS85311AM REV. D OCTOBER 22, 2008
Parameter Measurement Information, continued
Output Duty Cycle/Pulse Width/Period
Output Rise/Fall Time
Application Information
Wiring the Differential Input to Accept Single Ended Levels
Figure 1 shows how the differential input can be wired to accept
single ended levels. The reference voltage V_REF = VCC/2 is
generated by the bias resistors R1, R2 and C1. This bias circuit
should be located as close as possible to the input pin. The ratio of
R1 and R2 might need to be adjusted to position the V_REF in the
center of the input voltage swing. For example, if the input clock
swing is only 2.5V and VCC = 3.3V, V_REF should be 1.25V and
R2/R1 = 0.609.
Figure 1. Single-Ended Signal Driving Differential Input
nQ[0:1]
Q[0:1]
t
PW
t
PERIOD
t
PW
t
PERIOD
odc =
x 100%
20%
80%
20%
tR
t F
VSWING
nQ[0:1]
Q[0:1]
V_REF
Single Ended Clock Input
VCC
CLK
nCLK
R1
1K
C1
0.1u
R2
1K
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