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參數資料
| 型號： | ICS845252AKILF |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數： | 2/17頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLK GENERATOR CML 32VFQFN |
| 標準包裝： | 490 |
| 系列： | HiPerClockS™, FemtoClock™ |
| 類型： | * |
| PLL： | 帶旁路 |
| 輸入： | LVCMOS，LVTTL，晶體 |
| 輸出： | CML |
| 電路數： | 1 |
| 比率 - 輸入:輸出： | 2:2 |
| 差分 - 輸入:輸出： | 無/是 |
| 頻率 - 最大： | 312.5MHz |
| 除法器/乘法器： | 是/無 |
| 電源電壓： | 2.375 V ~ 3.465 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 32-VFQFN 裸露焊盤 |
| 供應商設備封裝： | 32-VFQFPN 裸露焊盤（4x4） |
| 包裝： | 托盤 |
ICS845252AKI REVISION A SEPTEMBER 30, 2009
10
2009 Integrated Device Technology, Inc.
ICS845252I Data Sheet
FEMTOCLOCK CRYSTAL-TO-CML CLOCK GENERATOR
Application Information
Power Supply Filtering Technique
As in any high speed analog circuitry, the power supply pins are
vulnerable to random noise. To achieve optimum jitter performance,
power supply isolation is required. The ICS845252I provides
separate power supplies to isolate any high switching noise from the
outputs to the internal PLL. VDD and VDDA should be individually
connected to the power supply plane through vias, and 0.01F
bypass capacitors should be used for each pin. Figure 1 illustrates
this for a generic VDD pin and also shows that VDDA requires that an
additional 10
resistor along with a 10F bypass capacitor be
connected to the VDDA pin.
Figure 1. Power Supply Filtering
Recommendations for Unused Input and Output Pins
Inputs:
LVCMOS Control Pins
All control pins have internal pullups and pulldowns; additional
resistance is not required but can be added for additional protection.
A 1k
resistor can be used.
Crystal Inputs
For applications not requiring the use of the crystal oscillator input,
both XTAL_IN and XTAL_OUT can be left floating. Though not
required, but for additional protection, a 1k
resistor can be tied from
XTAL_IN to ground.
REF_CLK Input
For applications not requiring the use of the reference clock,
it can be left floating. Though not required, but for additional
protection, a 1k
resistor can be tied from the REF_CLK to ground.
Outputs:
CML Outputs
All unused CML outputs can be left floating. We recommend that
there is no trace attached. Both sides of the differential output pair
should either be left floating or terminated.
VDD
VDDA
3.3V or 2.5V
10
10F
.01F
相關PDF資料 |
PDF描述 |
|---|---|
| ICS850S1201BGILF | IC CLOCK MUX 12:1 250MHZ 20TSSOP |
| ICS851010AYLFT | IC CLK BUFFER 1:10 250MHZ 32TQFP |
| ICS851021AYLF | IC CLK BUFFER 1:21 250MHZ 64TQFP |
| ICS85102AGILFT | IC CLOCK BUFFER MUX 2:2 16-TSSOP |
| ICS85104AGILFT | IC CLOCK BUFFER MUX 2:4 20-TSSOP |
相關代理商/技術參數 |
參數描述 |
|---|---|
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| ICS848004AGILF | 功能描述:IC SYNTHESIZER FIBRE CH 24-TSSOP RoHS:是 類別:集成電路 (IC) >> 時鐘/計時 - 時鐘發(fā)生器，PLL，頻率合成器 系列:HiPerClockS™, FemtoClock™ 標準包裝:1,000 系列:- 類型:時鐘/頻率合成器，扇出分配 PLL:- 輸入:- 輸出:- 電路數:- 比率 - 輸入:輸出:- 差分 - 輸入:輸出:- 頻率 - 最大:- 除法器/乘法器:- 電源電壓:- 工作溫度:- 安裝類型:表面貼裝 封裝/外殼:56-VFQFN 裸露焊盤 供應商設備封裝:56-VFQFP-EP（8x8） 包裝:帶卷 (TR) 其它名稱:844S012AKI-01LFT |
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