IDT / ICS LVDS CLOCK GENERATOR 7 I" />
參數(shù)資料
型號: ICS844008AKI-46LFT
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 13/15頁
文件大?。?/td> 0K
描述: IC CLK GEN 8LVDS 32-VFQFPN
標準包裝: 2,500
系列: HiPerClockS™, FemtoClock™
類型: 時鐘/頻率合成器,扇出分配
PLL:
輸入: 晶體
輸出: LVDS
電路數(shù): 1
比率 - 輸入:輸出: 1:8
差分 - 輸入:輸出: 無/是
頻率 - 最大: 156.25MHz
除法器/乘法器: 是/無
電源電壓: 2.375 V ~ 2.625 V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 32-VFQFN 裸露焊盤
供應商設備封裝: 32-VFQFPN 裸露焊盤(4x4)
包裝: 帶卷 (TR)
其它名稱: 844008AKI-46LFT
IDT / ICS LVDS CLOCK GENERATOR
7
ICS844008AKI-46 REV. A MAY 19, 2008
ICS844008I-46
FEMTOCLOCKS CRYSTAL-TO-LVDS CLOCK GENERATOR
DIFFERENTIAL OUTPUT VOLTAGE SETUP
OFFSET VOLTAGE SETUP
out
LVDS
DC Input
VOS/Δ VOS
V
DD
100
out
LVDS
DC Input
VOD/Δ VOD
V
DD
PARAMETER MEASUREMENT INFORMATION, CONTINUED
APPLICATION INFORMATION
As in any high speed analog circuitry, the power supply pins are
vulnerable to random noise. To achieve optimum jitter perfor-
mance, power supply isolation is required. The ICS844008I-46
provides separate power supplies to isolate any high switching
noise from the outputs to the internal PLL. V
DD, VDDA, and VDDO
should be individually connected to the power supply
plane through vias, and 0.01F bypass capacitors should be used
for each pin.
Figure 1 illustrates this for a generic V
CC pin and
also shows that V
DDA requires that an additional 10Ω resistor
along with a 10F bypass capacitor be connected to the V
DDA
pin.
POWER SUPPLY FILTERING TECHNIQUES
FIGURE 1. POWER SUPPLY FILTERING
10
Ω
V
DDA
10
μF
.01
μF
2.5V
.01
μF
V
DD
相關PDF資料
PDF描述
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相關代理商/技術參數(shù)
參數(shù)描述
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