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參數(shù)資料
| 型號： | ICS84314AY-02LF |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 22/23頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC SYNTHESIZER 700MHZ 32-LQFP |
| 標準包裝： | 250 |
| 系列： | HiPerClockS™ |
| 類型： | 頻率合成器 |
| PLL： | 帶旁路 |
| 輸入： | 晶體 |
| 輸出： | LVPECL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:4 |
| 差分 - 輸入:輸出： | 無/是 |
| 頻率 - 最大： | 700MHz |
| 除法器/乘法器： | 是/無 |
| 電源電壓： | 3.135 V ~ 3.465 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 32-LQFP |
| 供應(yīng)商設(shè)備封裝： | 32-TQFP（7x7） |
| 包裝： | 托盤 |
| 其它名稱： | 800-2281 84314AY-02LF ICS84314AY-02LF-ND |
ICS84314-02
700MHZ, CRYSTAL-TO-3.3V/2.5V LVPECL FREQUENCY SYNTHESIZER W/FANOUT BUFFER
IDT / ICS 3.3V/2.5V LVPECL FREQUENCY SYNTHESIZER
8
ICS84314AY-02 REV. A MARCH 24, 2009
Table 6. Crystal Characteristics
AC Electrical Characteristics
Table 7. AC Characteristics, VCC = 3.3V±5%, VCCO = 3.3V±5% or 2.5V±5%, VEE = 0V, TA = 0°C to 70°C
NOTE: Electrical parameters are guaranteed over the specified ambient operating temperature range, which is established when the
device is mounted in a test socket with maintained transverse airflow greater than 500 lfpm. The device will meet specifications after
thermal equilibrium has been reached under these conditions.
See Parameter Measurement Information section.
NOTE 1: Jitter performance using crystal inputs.
NOTE 2: Defined as skew between outputs at the same supply voltage and with equal load conditions. Measured from the output
differential cross points.
NOTE 3: This parameter is defined in accordance with JEDEC Standard 65.
NOTE 4: Spread Spectrum clocking enabled. XTAL = 20MHz, fOUT = 100MHz, M = 160, N = 4.
NOTE 5: PLL Lock Time when changing M Divider through serial or parallel programming.
Parameter
Test Conditions
Minimum
Typical
Maximum
Units
Mode of Oscillation
Fundamental
Frequency
12
40
MHz
Equivalent Series Resistance (ESR)
50
Shunt Capacitance
7pF
Symbol
Parameter
Test Conditions
Minimum
Typical
Maximum
Units
fMAX
Output Frequency Range
31.25
700
MHz
tjit(cc)
Cycle-to-Cycle Jitter; NOTE 1, 3
N
≠ ÷1
45
ps
N = ÷1
60
ps
tjit(per)
Period Jitter, RMS; NOTE 1
N
≠ ÷1
6
ps
tsk(o)
Output Skew; NOTE 2, 3
40
ps
tR / tF
Output Rise/Fall Time
20% to 80%
200
700
ps
tS
Setup Time
nP_LOAD to M
5
ns
S_DATA to S_CLOCK
5
ns
S_CLOCK to S_LOAD
5
ns
tH
Hold Time
nP_LOAD to M
5
ns
S_DATA to S_CLOCK
5
ns
S_CLOCK to S_LOAD
5
ns
FM
SSC Modulation Frequency;
NOTE 4
30
33.33
kHz
FMF
SSC Modulation Factor; NOTE 4
-0.6
-0.8
%
SSCRED Spectral Reduction; NOTE 4
7
10
dB
odc
Output Duty Cycle
N
≠ ÷1
47
53
%
tLOCK
PLL Lock Time
from Power-up
20
ms
tRE-LOCK PLL Re-Lock Time; NOTE 5
1ms
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PDF描述 |
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參數(shù)描述 |
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