參數(shù)資料
型號： ICS843002AKI-41LFT
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 18/24頁
文件大小： 0K
描述： IC SYNTHESIZER LVPECL 32-VFQFPN
標(biāo)準(zhǔn)包裝： 2,500
系列： HiPerClockS™, FemtoClock™
類型： 時鐘發(fā)生器，時鐘同步器，頻率變換器，抖動衰減器，多路復(fù)用器
PLL： 帶旁路
輸入： HCSL，LVCMOS，LVDS，LVHSTL，LVPECL，LVTTL，SSTL
輸出： LVPECL
電路數(shù)： 1
比率 - 輸入:輸出： 3:2
差分 - 輸入:輸出： 是/是
頻率 - 最大： 175MHz
除法器/乘法器： 是/是
電源電壓： 3.135 V ~ 3.465 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 32-VFQFN 裸露焊盤
供應(yīng)商設(shè)備封裝： 32-VFQFPN 裸露焊盤（4x4）
包裝： 帶卷 (TR)
其它名稱： 843002AKI-41LFT
ICS843002I-41
700MHZ, FEMTOCLOCK VCXO BASED SONET/SDH JITTER ATTENUATOR
IDT / ICS VCXO BASED SONET/SDH JITTER ATTENUATOR
3
ICS843002AKI-41 REV. B
APRIL 7, 2009
Table 1. Pin Descriptions
NOTE: Pullup and Pulldown refer to internal input resistors. See Table 2, Pin Characteristics, for typical values.
Number
Name
Type
Description
1, 2
LF1, LF0
Analog
Input/Output
Loop filter connection node pins.
3
ISET
Analog
Input/Output
Charge pump current setting pin.
4VCC
Power
Core power supply pin.
5
CLK0
Input
Pulldown
Non-inverting differential clock input.
6nCLK0
Input
Pullup
Pulldown
Inverting differential clock input. VCC/2 bias voltage when left floating.
7
CLK_SEL
Input
Pulldown
Input clock select. LVCMOS/LVTTL interface levels. See Table 3A.
8
QA_SEL2
Input
Pulldown
Output divider control for QA/nQA LVPECL outputs.
LVCMOS/LVTTL interface levels.See Table 3C.
9,
10
QA_SEL1,
QA_SEL0
Input
Pullup
Output divider control for QA/nQA LVPECL outputs.
LVCMOS/LVTTL interface levels.See Table 3C.
11
QB_SEL2
Input
Pulldown
Output divider control for QB/nQB LVPECL outputs.
LVCMOS/LVTTL interface levels.See Table 3C.
12,
13
QB_SEL1,
QB_SEL0
Input
Pullup
Output divider control for QB/nQB LVPECL outputs.
LVCMOS/LVTTL interface levels.See Table 3C.
14
VCCA
Power
Analog supply pin.
15, 16
QA, nQA
Output
Differential clock output pair. LVPECL interface levels.
17, 27
VEE
Power
Negative supply pins.
18, 19
QB, nQB
Output
Differential clock output pair. LVPECL interface levels.
20
VCCO_LVPECL
Power
Output supply pin for LVPECL outputs.
21
VCCO_LVCMOS
Power
Output supply pin for LVCMOS/LVTTL outputs.
22
nc
Unused
No connect.
23
LOR1
Output
Alarm output, loss of reference for CLK1/nCLK1.
LVCMOS/LVTTL interface levels.
24
LOR0
Output
Alarm output, loss of reference for CLK0/nCLK0.
LVCMOS/LVTTL interface levels.
25
nCLK1
Input
Pullup
Pulldown
Inverting differential clock input. VCC/2 bias voltage when left floating.
26
CLK1
Input
Pulldown
Non-inverting differential clock input.
28,
29,
30
R_SEL0,
R_SEL1,
R_SEL2
Input
Pulldown
Input divider selection. LVCMOS/LVTTL interface levels. See Table 3B.
31,
32
XTAL_OUT,
XTAL_IN
Input
Crystal oscillator interface. The XTAL_IN is the input.
XTAL_OUT is the output.
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