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參數(shù)資料
| 型號： | ICS842AFLF |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | 時鐘及定時 |
| 英文描述： | 95V SERIES, PLL BASED CLOCK DRIVER, 1 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO16 |
| 封裝： | 0.150 INCH, LEAD FREE, MO-137, SSOP-16 |
| 文件頁數(shù)： | 1/10頁 |
| 文件大小： | 100K |
| 代理商： | ICS842AFLF |
Integrated
Circuit
Systems, Inc.
ICS95V842
0830A—09/10/04
Block Diagram
DDR Phase Lock Loop Clock Driver (60MHz - 220MHz)
Pin Configuration
Recommended Application:
1:2 DDRI Clock Driver
Product Description/Features:
Low skew, low jitter PLL clock driver
Feedback pins for input to output synchronization
Spread Spectrum tolerant inputs
With bypass mode mux
Operating frequency 60 to 220 MHz
Switching Characteristics:
CYCLE - CYCLE jitter: <75ps
OUTPUT - OUTPUT skew: <60ps
Period jitter: ±75ps
Half-Period jitter: ±75ps
Functionality
S
T
U
P
N
IS
T
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P
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O
e
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S
L
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D
V
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(
HL
H
L
H
L
n
O
VDD2.5 1
16 GND
DDRT0 2
15 DDRC1
DDRC0 3
14 DDRT1
GND 4
13 VDD2.5
CLK_INT 5
12 FB_INC
CLK_INC 6
11 FB_INT
AVDD 7
10 FB_OUTT
AGND 8
9 FB_OUTC
16 pin SSOP
IC
S
9
5
V
842
PLL
FB_INT
FB_INC
CLK_INC
CLK_INT
FB_OUTT
FB_OUTC
DDRT (1:0)
DDRC(1:0)
AVDD
相關(guān)PDF資料 |
PDF描述 |
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