IDT / ICS HCSL CLOCK GENERATOR 10 " />
參數(shù)資料
型號: ICS841604AGILFT
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 2/16頁
文件大?。?/td> 0K
描述: IC CLOCK GENERATOR 28-TSSOP
產品培訓模塊: PCI-Express
標準包裝: 1,000
系列: HiPerClockS™, FemtoClock™
類型: 時鐘發(fā)生器,扇出配送,多路復用器
PLL: 帶旁路
輸入: LVCMOS,LVTTL,晶體
輸出: HCSL
電路數(shù): 1
比率 - 輸入:輸出: 2:4
差分 - 輸入:輸出: 無/是
頻率 - 最大: 125MHz
除法器/乘法器: 是/無
電源電壓: 3.135 V ~ 3.465 V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 28-TSSOP(0.240",6.10mm 寬)
供應商設備封裝: 28-TSSOP
包裝: 帶卷 (TR)
其它名稱: 841604AGILFT
IDT / ICS HCSL CLOCK GENERATOR
10
ICS841604AGI REV. A JULY 10, 2008
ICS841604I
FEMTOCLOCKS CRYSTAL-TO-HCSL CLOCK GENERATOR
FIGURE 4. ICS841604I SCHEMATIC EXAMPLE
SCHEMATIC EXAMPLE
Figure 4 shows an example of ICS841604I application schematic.
In this example, the device is operated at V
DD
= 3.3V. The 18pF
parallel resonant 25MHz crystal is used. The C1 = 27pF and C2
= 27pF are recommended for frequency accuracy. For different
board layout, the C1 and C2 may be slightly adjusted for optimizing
frequency accuracy. Two examples of HCSL terminations are
shown in this schematic. The decoupling capacitors should be
located as close as possible to the power pin.
VDD
BY PASS
VDD A
MR/nOE
TL3
Zo = 50
RD1
Not Install
R7
50
(U1:8)
VDD
C4
0.1u
HCSL Termination
R EF_SEL
R2
33
18pF
C6
.1uf
VDD=3.3V
R6
50
TL4
Zo = 50
RU2
Not Install
C8
.1uf
VDD
RU1
1K
Set Logic
Input to
'0'
C5
.1uf
To Logic
Input
pins
TL1
Zo = 50
R8
50
C2
27pF
(U1:14)
VDD
+
-
VDD
To Logic
Input
pins
R4
33
R5
50
C3
10u
C1
27pF
VDD
+
-
FSEL
U1
ICS841604I
1
2
3
4
5
6
7
8
9
10
19
20
21
22
23
24
28
27
26
25
11
12
18
17
13
14
16
15
REF_SEL
REF_IN
VDD
GND
XTAL_IN
XTAL_OU T
MR_nOE
VDD
nc
GND
Q2
nQ2
Q3
nQ3
VDD
VDDA
BY PASS
IREF
FSEL
nc
nQ1
Q1
GND
VDD
nQ0
Q0
(U1:3)
VDD
R3
475
TL2
Zo = 50
Recommended for
PCI Express Add-In
Card
X1
25MHz
(U1:24)
VDD
RD2
1K
Logic Control Input Examples
Set Logic
Input to
'1'
C7
.1uf
Recommended for PCI
Express Point-to-Point
Connection
R1
10
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