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參數資料
| 型號： | ICS840004BGI-01LFT |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數： | 11/18頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FREQ SYNTHESIZER 20TSSOP |
| 標準包裝： | 2,500 |
| 系列： | HiPerClockS™, FemtoClock™ |
| 類型： | 頻率合成器 |
| PLL： | 帶旁路 |
| 輸入： | LVCMOS，LVTTL，晶體 |
| 輸出： | LVCMOS，LVTTL |
| 電路數： | 1 |
| 比率 - 輸入:輸出： | 2:4 |
| 差分 - 輸入:輸出： | 無/無 |
| 頻率 - 最大： | 156.25MHz |
| 除法器/乘法器： | 是/無 |
| 電源電壓： | 2.375 V ~ 3.465 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 20-TSSOP（0.173"，4.40mm 寬） |
| 供應商設備封裝： | 20-TSSOP |
| 包裝： | 帶卷 (TR) |
ICS840004I-01
FEMTOCLOCKS CRYSTAL-TO-LVCMOS/LVTTL CLOCK SYNTHESIZER
IDT / ICS LVCMOS/LVTTL FREQUENCY SYNTHESIZER
2
ICS840004BGI-01 REV. C FEBRUARY 9, 2009
Table 1. Pin Descriptions
NOTE: Pullup and Pulldown refer to internal input resistors. See Table 2, Pin Characteristics, for typical values.
Table 2. Pin Characteristics
Number
Name
Type
Description
1, 20
F_SEL0,
F_SEL1
Input
Pullup
Frequency select pins. LVCMOS/LVTTL interface levels.
2, 9
nc
Unused
No connect.
3
nXTAL_SEL
Input
Pulldown
Selects betweent he crystal or REF_CLK inputs as the PLL reference
source. When HIGH, selects REF_CLK. When LOW, selects XTAL
inputs. LVCMOS/LVTTL interface levels.
4
REF_CLK
Input
Pulldown
Single-ended reference clock input. LVCMOS/LVTTL interface levels.
5
OE
Input
Pullup
Output enable pin. When HIGH, the outputs are active. When LOW, the
outputs are in a high impedance state. LVCMOS/LVTTL interface levels.
6
MR
Input
Pulldown
Active HIGH master reset. When logic HIGH, the internal dividers are
reset causing the outputs to go low. When logic LOW, the internal
dividers and the outputs are enabled. LVCMOS/LVTTL interface levels.
7
nPLL_SEL
Input
Pulldown
PLL bypass. When LOW, the output is driven from the VCO output.
When HIGH, the PLL is bypassed and the output frequency = reference
clock frequency/N output divider. LVCMOS/LVTTL interface levels.
8VDDA
Power
Analog supply pin.
10
VDD
Power
Core supply pin.
11,
12
XTAL_OUT,
XTAL_IN
Input
Crystal oscillator interface. XTAL_IN is the input. XTAL_OUT is the
output.
13, 19
GND
Power
Power supply ground.
14, 15, 17, 18
Q3, Q2, Q1, Q0
Output
Single-ended clock outputs. 17
typical output impedance.
LVCMOS/ LVTTL interface levels.
16
VDDO
Power
Output supply pin.
Symbol
Parameter
Test Conditions
Minimum
Typical
Maximum
Units
CIN
Input Capacitance
4
pF
CPD
Power Dissipation Capacitance
8
pF
RPULLUP
Input Pullup Resistor
51
k
RPULLDOWN Input Pulldown Resistor
51
k
ROUT
Output Impedance
VDDO = 3.3V±5%
17
VDDO = 2.5V±5%
21
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