VCXO JITTER ATTENUATOR & FEM" />
參數(shù)資料
型號： ICS813323BGLF
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 12/22頁
文件大?。?/td> 0K
描述： IC ATTENUATOR/MULTIPLIER 24TSSOP
標(biāo)準(zhǔn)包裝： 62
系列： HiPerClockS™, FemtoClock™
類型： 扇出配送，頻率變換器，抖動衰減器，壓控晶體振蕩器（VCXO）
PLL： 帶旁路
輸入： HCSL，LVDS，LVHSTL，LVPECL，SSTL
輸出： LVPECL
電路數(shù)： 1
比率 - 輸入:輸出： 2:3
差分 - 輸入:輸出： 是/是
頻率 - 最大： 622.08MHz
除法器/乘法器： 是/無
電源電壓： 3.135 V ~ 3.465 V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 24-TSSOP（0.173"，4.40mm 寬）
供應(yīng)商設(shè)備封裝： 24-TSSOP
包裝： 管件
其它名稱： 813323BGLF
ICS813323BG REVISION A APRIL 13, 2010
2
2010 Integrated Device Technology, Inc.
ICS813323 Data Sheet
VCXO JITTER ATTENUATOR & FEMTOCLOCKMULTIPLIER
Table 1. Pin Descriptions
NOTE: Pullup and Pulldown refer to internal input resistors. See Table 2, Pin Characteristics, for typical values.
Table 2. Pin Characteristics
Function Tables
Table 3A. Pre-Divider Selection Function Table
Table 3B. FSEL Function Table
Number
Name
Type
Description
1LF
Analog
Input/Output
Loop filter connection node pin.
2VCCA
Power
Analog supply pin.
3VCC
Power
Core supply pin.
4, 23
VCCO
Power
Output power supply pins.
5, 6
19, 20
21, 22
nQ0, Q0
Q1, nQ1
Q2, nQ2
Output
Differential clock outputs. LVPECL interface levels.
7,
9
PSEL0,
PSEL1
Input
Pullup
Pre-divider select pins. LVCMOS/LVTTL interface levels. See Table 3A.
8, 12, 17
VEE
Power
Negative supply pins.
10,
11
XTAL_OUT,
XTAL_IN
Input
VCXO crystal oscillator interface. XTAL_IN is the input. XTAL_OUT is the
output.
13
nCLK
Input
Pullup/
Pulldown
Inverting differential clock input. VCC/2 bias voltage when left floating.
14
CLK
Input
Pulldown
Non-inverting differential clock input.
15
nBypass
Input
Pullup
PLL Bypass control pin. See Table 3D.
16,
18
FSEL1,
FSEL0
Input
Pullup
Select pins. See Table 3B.
24
OE
Input
Pullup
Output enable. When logic LOW, the clock outputs are in High-Impedance.
When logic HIGH, the clock outputs are enabled. LVCMOS/LVTTL interface
levels. See Table 3C.
Symbol
Parameter
Test Conditions
Minimum
Typical
Maximum
Units
CIN
Input Capacitance
4pF
RPULLUP
Input Pullup Resistor
51
k
RPULLDOWN
Input Pulldown Resistor
51
k
Inputs
Pre-Divider Value
PSEL1
PSEL0
00
÷1
01
÷4
10
÷8
1
÷32 (default)
Inputs
Output Divider Value
FSEL1
FSEL0
00
÷1
01
÷4
10
÷8
1
÷32 (default)
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