參數(shù)資料
型號: ICS580M-01LFT
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 8/13頁
文件大小: 0K
描述: IC CLK MUX ZERO DLAY BUFF 16SOIC
產(chǎn)品培訓模塊: Clock Distibution and Generation 1.0
標準包裝: 2,500
類型: 多路復用器,零延遲緩沖器
電路數(shù): 1
比率 - 輸入:輸出: 2:2
差分 - 輸入:輸出: 無/無
輸入: 時鐘
輸出: 時鐘
頻率 - 最大: 270MHz
電源電壓: 2.5 V ~ 5.5 V
工作溫度: 0°C ~ 70°C
安裝類型: 表面貼裝
封裝/外殼: 16-SOIC(0.154",3.90mm 寬)
供應商設備封裝: 16-SOIC
包裝: 帶卷 (TR)
其它名稱: 580M-01LFT
ICS580-01
GLITCH-FREE CLOCK MULITPLEXER
CLOCK MULTIPLEXER
IDT / ICS GLITCH-FREE CLOCK MULITPLEXER
4
ICS580-01
REV L 051310
Device Operation
The ICS580-01 consists of a glitch free mux between INA and INB controlled by SELB. The device is designed to
switch between two clocks, whether running or not. In the first example, clocks are running on both INA and INB.
When SELB changes, the output clock goes low after three cycles of the output clock (nominally). The output then
stays low for three cycles of the new input clock (nominally) and then starts with the new input clock. This is shown
in Figure 1.
In the second example, one of the inputs was selected and running but has since stopped (either high or low). This
is indicated by either NO_INA or NO_INB going high depending on whether INA or INB has stopped. These signals
go high following a selectable time-out period after the clock has stopped. The timeout period is determined by the
DIV input in. The SELB pin is now changed to select the new input clock which is running. The output clock
immediately goes low and stays low for three cycles of the new input clock and then starts with the new input clock.
Figure 2 shows an example of this
INA
INB
SELB
CLK1, 2
Figure 1
INA
INB
SELB
NO_INA
Figure 2
Timeout
CLK1, 2
相關PDF資料
PDF描述
AD5321BRMZ-REEL IC DAC 12BIT 2WIRE I2C 8-MSOP
AD5304BRMZ-REEL IC DAC 8BIT QUAD VOUT 10-MSOP TR
VE-J3B-MY CONVERTER MOD DC/DC 95V 50W
VE-J34-MY CONVERTER MOD DC/DC 48V 50W
VE-B31-MV-F1 CONVERTER MOD DC/DC 12V 150W
相關代理商/技術參數(shù)
參數(shù)描述
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