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參數(shù)資料
| 型號： | ICS571MLFT |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 2/7頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC BUFFER ZD LOW PH/NOISE 8-SOIC |
| 標準包裝： | 1 |
| 系列： | ClockBlocks™ |
| 類型： | 扇出緩沖器（分配），零延遲緩沖 |
| PLL： | 是 |
| 輸入： | CMOS |
| 輸出： | CMOS |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:2 |
| 差分 - 輸入:輸出： | 無/無 |
| 頻率 - 最大： | 160MHz |
| 除法器/乘法器： | 是/是 |
| 電源電壓： | 3 V ~ 5.5 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 8-SOIC（0.154"，3.90mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 8-SOIC |
| 包裝： | 標準包裝 |
| 其它名稱： | 800-1809-6 |
ICS571
LOW PHASE NOISE ZERO DELAY BUFFER
ZDB AND MULTIPLIER/DIVIDER
IDT / ICS LOW PHASE NOISE ZERO DELAY BUFFER
2
ICS571
REV H 051310
Pin Assignment
Feedback Configuration Table and Frequency Ranges (at 3.3 V)
Pin Descriptions
Key: CI = clock input; I = input; O = output; P = power supply connection.
Feedback From
CLK
CLK/2
Input Range
CLK
Input clock frequency
Input clock frequency/2
20 to 160 MHz
CLK/2
2x Input clock frequency
Input clock frequency
10 to 80 MHz
Pin
Number
Pin
Name
Pin
Type
Pin Description
1
ICLK
CI
Reference clock input.
2
VDD
P
Connect to +3.3 V or +5 V. Must be same as other VDD.
3
GND
P
Connect to ground.
4
CLK/2
O
Clock output per table above. Low skew divide by two of pin 7 clock.
5
GND
P
Connect to ground.
6
VDD
P
Connect to +3.3 V or +5 V. Must be same as other VDD.
7
CLK
O
Clock output per table above.
8
FBIN
CI
Feedback clock input. Connect to CLK or CLK/2 per table above.
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PDF描述 |
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參數(shù)描述 |
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| ICS574MILF | 功能描述:IC CLOCK ZDB 1:4 160MHZ 8SOIC RoHS:是 類別:集成電路 (IC) >> 時鐘/計時 - 時鐘發(fā)生器，PLL，頻率合成器 系列:- 標準包裝:2,000 系列:- 類型:PLL 頻率合成器 PLL:是 輸入:晶體 輸出:時鐘 電路數(shù):1 比率 - 輸入:輸出:1:1 差分 - 輸入:輸出:無/無 頻率 - 最大:1GHz 除法器/乘法器:是/無 電源電壓:4.5 V ~ 5.5 V 工作溫度:-20°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:16-LSSOP（0.175"，4.40mm 寬） 供應(yīng)商設(shè)備封裝:16-SSOP 包裝:帶卷 (TR) 其它名稱:NJW1504V-TE1-NDNJW1504V-TE1TR |
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