參數(shù)資料
型號： ICS557G-06LFT
元件分類： 時鐘及定時
英文描述： 557 SERIES, LOW SKEW CLOCK DRIVER, 4 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO20
封裝： 0.173 INCH, ROHS COMPLIANT, TSSOP-20
文件頁數(shù)： 3/10頁
文件大?。?/td> 203K
代理商： ICS557G-06LFT
MDS 557-06 C
2
Revision 010306
In te gr ated Circuit Systems ● 525 Ra ce Street, San Jose, CA 9512 6 ● tel (4 08) 297-1 201 ● www.icst.com
ICS557-06
One to Four HCSL Clock Buffer
Pin Assignment
Select Table
Pin Descriptions
13
4
12
5
11
IN2
8
9
10
GND
OE
CLKC
CLKD
GND
CLKD
17
16
IREF
3
IN1
CLKB
18
CLKB
1
SEL
VDDIN
CLKA
20
CLKA
19
14
2
7
IN2
PD
VDD
CLKC
15
6
20-pin (173 mil) TSSOP
SEL
Input Pair
selected
0IN2/ IN2
1IN1/ IN1
Pin
Name
Pin
Type
Pin Description
1
SEL
Input
SEL=1 selects IN1/IN1. SEL =0 selects IN2/ IN2. Internal pull-up resistor.
2
VDDIN
Power
Connect to +3.3 V. Supply voltage for Input clocks.
3
IN1
Input
HCSL/LVDS true input signal 1.
4IN1
Input
HCSL/LVDS complimentary input signal 1.
5PD
Input
Powers down the chip and tri-states outputs when low. Internal pull-up resistor.
6
IN2
Input
HCSL/LVDS true input signal 2.
7IN2
Input
HCSL/LVDS complimentary input signal 2.
8
OE
Input
Provides fast output on, tri-states output (High = enable outputs; Low = disable).
Internal pull-up resistor outputs.
9
GND
Power
Connect to ground.
10
Rr(IREF)
Output
Precision resistor attached to this pin is connected to the internal current reference.
11
CLKD
Output
Differential Complimentary output clock D.
12
CLKD
Output
Differential True output clock D.
13
CLKC
Output
Differential Complimentary output clock C.
14
CLKC
Output
Differential True output clock C.
15
VDDOUT
Power
Connect to +3.3 V. Supply Voltage for Output Clocks.
16
GND
Power
Connect to ground.
17
CLKB
Output
Differential Complimentary output clock B.
18
CLKB
Output
Differential True output clock B.
19
CLKA
Output
Differential Complimentary output clock A.
20
CLKA
Output
Differential True output clock A.
相關(guān)PDF資料
PDF描述
ICS557G-06T 557 SERIES, LOW SKEW CLOCK DRIVER, 4 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO20
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