參數(shù)資料
型號(hào): ICS553M
英文描述: LOW SKEW 1 TO 4 CLOCK BUFFER
中文描述: 低偏移的1至4時(shí)鐘緩沖器
文件頁(yè)數(shù): 2/6頁(yè)
文件大?。?/td> 89K
代理商: ICS553M
L
OW
S
KEW
1
TO
4 C
LOCK
B
UFFER
MDS 553 B
2
Revision 052501
Integrated Circuit Systems
G
525 Race Street, San Jose, CA 95126
G
tel (408) 295-9800
G
www.icst.com
ICS553
Pin Assignment
Pin Descriptions
External Components
A minimum number of external components are required for proper operation. A decoupling capacitor of
0.01
μ
F should be connected between VDD on pin 1 and GND on pin 4, as close to the device as possible.
A 33
series terminating resistor may be used on each clock output if the trace is longer than 1 inch.
To achieve the low output skew that the ICS553 is capable of, careful attention must be paid to board
layout. Essentially, all 4 outputs must have identical terminations, identical loads and identical trace
geometries. If they do not, the output skew will be degraded. For example, using a 30
series termination
on one output (with 33
on the others) will cause at least 15ps of skew.
1
2
3
4
VDD
Q0
Q1
GND
Q3
Q2
ICLK
8
7
6
5
OE
8 Pin (150 mil) SOIC
Pin
Number
Pin
Name
Pin
Type
Pin Description
1
VDD
Power
Connect to +2.5V, +3.3V or +5.0V.
2
Q0
Output
Clock Output 0
3
Q1
Output
Clock Output 1
4
GND
Power
Ground
5
ICLK
Input
Clock Input. 5V tolerant input.
6
Q2
Output
Clock Output 2
7
Q3
Output
Clock Output 3
8
OE
Input
Output Enable. Tri-states outputs when low.
相關(guān)PDF資料
PDF描述
ICS553MT LOW SKEW 1 TO 4 CLOCK BUFFER
ICS554-01 LOW SKEW 1 TO 4 CLOCK BUFFER PECL IN, PECL OUT
ICS554G-01 LOW SKEW 1 TO 4 CLOCK BUFFER PECL IN, PECL OUT
ICS554G-01T LOW SKEW 1 TO 4 CLOCK BUFFER PECL IN, PECL OUT
ICS557-03 PCI-EXPRESS CLOCK SOURCE
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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