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參數(shù)資料
| 型號： | ICS307GI-03LF |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 8/14頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLK SOURCE SRL PROGR 16-TSSOP |
| 產品培訓模塊： | Clock Distibution and Generation 1.0 |
| 標準包裝： | 96 |
| 系列： | VersaClock™ II |
| 類型： | 時鐘發(fā)生器 |
| PLL： | 是 |
| 輸入： | 時鐘，晶體 |
| 輸出： | LVCMOS |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:3 |
| 差分 - 輸入:輸出： | 無/無 |
| 頻率 - 最大： | 270MHz |
| 除法器/乘法器： | 是/無 |
| 電源電壓： | 3 V ~ 3.6 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 16-TSSOP（0.173"，4.40mm 寬） |
| 供應商設備封裝： | 16-TSSOP |
| 包裝： | 管件 |
| 產品目錄頁面： | 1251 (CN2011-ZH PDF) |
| 其它名稱： | 307GI-03LF 800-1029 800-1029-5 800-1029-ND |
ICS307-03
SERIALLY PROGRAMMABLE CLOCK SOURCE
SER PROG CLOCK SYNTHESIZER
IDT SERIALLY PROGRAMMABLE CLOCK SOURCE
3
ICS307-03
REV L 032911
Table 1. Input Divider
Table 2. VCO Divider
Divide Value
12
11
10
9
8
7
Bits
6
543
210
Rule
1X
XXX
XX
X
0
1+ Bit 0
2X
XXX
XX
X
0
1
1 + Bit 0
3
X
1
0
1
0
subtract 2 from the
desired value, convert to
binary, invert, and apply
to bits 5...2
Bits [1..0] = 10
4
X
1
0
1
0
5
X
1
0
1
0
6
X
1
0
1
0
7
X
1
0
1
0
1
0
8
X
1
0
1
0
9
X
1
0
1
0
10
X
0
1
0
11
X
0
1
0
1
0
12
X
0
1
0
1
0
13
X
0
1
0
1
0
14
X
0
1
0
15
X
0
1
0
1
0
16
X
0
1
0
17
X
0
1
0
18
0
000
0
101
011
subtract 8 from the
desired divide value,
convert to binary, and
apply to bits 11...2
Bits [1..0] = 11
19
0
000
0
101
111
20
0
000
0
110
011
21
0
000
0
110
111
…
2054
1
111
1
111
011
2055
1
111
1
111
Bits
Divide Value
232221201918
1716151413
Rule
12
0
0000000
100
subtract 8 from the desired
divide value, convert to
binary, and apply to bits
23...13
13
0
0000000
101
14
0
0000000
110
…
2054
1
1111111
110
2055
1
1111111
111
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