參數(shù)資料
型號： ICS280PGLF
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 5/9頁
文件大?。?/td> 0K
描述： IC CLK SYNTH TRPL PLL 16-TSSOP
標準包裝： 96
系列： VersaClock™
類型： 時鐘/頻率合成器，扇出配送，擴展頻譜時鐘發(fā)生器
PLL： 帶旁路
輸入： 時鐘，晶體
輸出： CMOS
電路數(shù)： 1
比率 - 輸入:輸出： 1:4
差分 - 輸入:輸出： 無/無
頻率 - 最大： 200MHz
除法器/乘法器： 是/是
電源電壓： 3.135 V ~ 3.465 V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 16-TSSOP（0.173"，4.40mm 寬）
供應商設備封裝： 16-TSSOP
包裝： 管件
其它名稱： 280PGLF
800-2359-5
ICS280PGLF-ND
ICS280
TRIPLE PLL FIELD PROG. SPREAD SPECTRUM CLOCK SYNTHESIZER
EPROM CLOCK SYNTHESIZER
IDT TRIPLE PLL FIELD PROG. SPREAD SPECTRUM CLOCK SYNTHESIZER
5
ICS280
REV G 030212
DC Electrical Characteristics
Unless stated otherwise, VDD = 3.3 V ±5%, Ambient Temperature -40 to +85
° C
Note 1: Example with 25 MHz crystal input, four unloaded 33.3 MHz outputs.
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
Operating Voltage
VDD
3.135
3.465
V
Operating Supply Current
Input High Voltage
IDD
Config. Dependent - See
VersaClockTM Estimates
mA
Four 33.3333 MHz outs,
VDD=3.3V;
PDTS = 1, no load, Note 1
22
mA
PDTS = 0, no load
500
μA
Input High Voltage
VIH
S2:S0
VDD/2+1
V
Input Low Voltage
VIL
S2:S0
0.4
V
Input High Voltage, PDTS
VIH
VDD-0.5
V
Input Low Voltage, PDTS
VIL
0.4
V
Input High Voltage
VIH
ICLK
VDD/2+1
V
Input Low Voltage
VIL
ICLK
VDD/2-1
V
Output High Voltage
(CMOS High)
VOH
IOH = -4 mA
VDD-0.4
V
Output High Voltage
VOH
IOH = -8 mA (Low Drive);
IOH = -12 mA (High Drive)
2.4
V
Output Low Voltage
VOL
IOL = 8 mA (Low Drive);
IOL = 12 mA (High Drive)
0.4
V
Short Circuit Current
IOS
Low Drive
±40
mA
High Drive
±70
Nom. Output Impedance
ZO
20
Ω
Internal Pull-up Resistor
RPUS
S2:S0, PDTS
190
k
Ω
Internal Pull-down
Resistor
RPD
CLK outputs
120
k
Ω
Input Capacitance
CIN
Inputs
4
pF
相關PDF資料
PDF描述
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參數(shù)描述
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