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參數(shù)資料
| 型號： | ICS280PGLF |
| 英文描述： | Package Outline and Package Dimensions (16-pin TSSOP,173 Mil. Body) |
| 中文描述： | 封裝和封裝尺寸（16引腳TSSOP封裝，173軍醫(yī)。體） |
| 文件頁數(shù)： | 2/8頁 |
| 文件大?。?/td> | 160K |
| 代理商： | ICS280PGLF |
Triple PLL Field Prog. Spread Spectrum Clock Synthesizer
MDS 280 C
2
Revision 062205
Integrated Circuit Systems, Inc.
●
525 Race Street, San Jose, CA 95126
●
tel (408) 297-1201
●
www.icst.com
ICS280
PRELIMINARY INFORMATION
Pin Assignment
Pin Descriptions
12
11
10
1
2
3
4
5
6
7
8
9
S0
S1
VDD
PDTS
GND
CLK4
CLK3
GND
VDD
CLK1
S2
GND
VDD
X2
CLK2
16
15
14
13
16 pin (173 mil) TSSOP
X1/ICLK
Pin
Number
1
2
3
4
5
6
7
8
9
10
11
12
13
Pin
Name
GND
S0
S1
VDD
CLK1
CLK2
GND
X1/ICLK
X2
VDD
CLK3
CLK4
GND
Pin
Type
Power
Input
Input
Power
Output
Output
Power
XI
XO
Power
Output
Output
Power
Pin Description
Connect to ground.
Select pin 0. Internal pull-up resistor.
Select pin 1. Internal pull-up resistor.
Connect to +3.3 V.
Output clock 1. Weak internal pull-down when tri-state.
Output clock 2. Weak internal pull-down when tri-state.
Connect to ground.
Crystal input. Connect this pin to a crystal or external input clock.
Crystal Output. Connect this pin to a crystal. Float for clock input.
Connect to +3.3 V.
Output clock 3. Weak internal pull-down when tri-state.
Output clock 4. Weak internal pull-down when tri-state.
Connect to ground.
Power-down tri-state. Powers down entire chip and tri-states clock outputs
when low. Internal pull-up resistor.
Connect to +3.3 V.
14
PDTS
Input
15
16
VDD
S2
Power
Input
Select pin 2. Internal pull-up resistor.
相關PDF資料 |
PDF描述 |
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參數(shù)描述 |
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