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參數(shù)資料
| 型號(hào)： | IA6805E2PLC44IR0 |
| 廠商： | Innovasic Semiconductor |
| 文件頁數(shù)： | 19/33頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MCU 8BIT 5MHZ 44PLCC |
| 標(biāo)準(zhǔn)包裝： | 270 |
| 芯體尺寸： | 8-位 |
| 速度： | 5MHz |
| 外圍設(shè)備： | POR |
| 輸入/輸出數(shù)： | 20 |
| 程序存儲(chǔ)器類型： | 外部程序存儲(chǔ)器 |
| RAM 容量： | 128 x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 4.5 V ~ 5.5 V |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 44-LCC（J 形引線） |
| 包裝： | 管件 |
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IA6805E2
29 August 2007
Microprocessor Unit
As of Production Version 00
Bus Timing
VSS=0V, TA=TL to TH (Figure 19)
Num
V
= 5.0V ±10%
DD
f
= 5MHz
OSC
1 TTL, 100pF Load
Unit
Parameters
Min
Max
1
Cycle Time
1000
DC
ns
2
Pulse Width, DS Low
587
-
ns
3
Pulse Width, DS High
403
-
ns
4
Clock Transition
-
4
ns
8
RW_n
9
-
ns
9
Non-Muxed Address Hold
97
-
ns
11
RW_n Delay From DS Fall
-
40
ns
16
Non-Muxed Address Delay From AS Rise
-
11
ns
17
MPU Read Data Setup
18
-
ns
18
Read Data Hold
0
ns
19
MPU Data Delay, Write
-
0
ns
21
Write Data Hold
204
-
ns
23
Muxed Address Delay From AS Rise
-
26
ns
24
Muxed Address Valid to AS Fall
185
-
ns
25
Muxed Address Hold
103
-
ns
26
Delay DS Fall to AS Rise
190
-
ns
27
Pulse Width, AS High
203
-
ns
28
Delay, AS Fall to DS Rise
185
-
ns
VLOW = 0.8V, VHIGH = VDD – 2.0V, VDD = 5.0V ±10%
TA = TL to TH, CL on Port = 50pF, fOSC = 5MHz
ADDRESS_STROBE
PORT_INPUT
PORT_OUTPUT
t
PVASL
t
ASLPX
t
ASLPV
*NOTE
*Note: The address strobe of the first cycle of the next instruction.
Figure 14. I/O Port Timing
Copyright 2007
IA211081401-03
www.Innovasic.com
Customer Support:
Page 26 of 33
1-888-824-4184
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PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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