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參數(shù)資料
| 型號(hào)： | HYB25D256400AT-7.5 |
| 英文描述： | DDR Synchronous DRAM |
| 中文描述： | DDR同步DRAM |
| 文件頁數(shù)： | 7/76頁 |
| 文件大?。?/td> | 1218K |
| 代理商： | HYB25D256400AT-7.5 |
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2002-05-06
Page 7 of 76
HYB25D128400/800/160AT(L)
128-Mbit Double Data Rate SDRAM
Block Diagram (8Mb x 16)
R
1
DQS
CK, CK
DLL
RAS
CAS
CK
CS
WE
CK
C
Column-Address
Counter/Latch
Mode
Registers
9
C
D
A0-A11,
BA0, BA1
CK
E
14
14
I/O
G
ating
DM Mask Logic
Array
(40
9
6 x 256x 32)
Sense Amplifiers
Bank1
Bank2
Bank3
12
8
1
2
2
R
16
16
16
RInput
1
1
1
1
1
32
32
2
32
clk
Data
Mask
Data
CK,
CK
COL0
COL0
COL0
clk
in
M
X
G
DQS
16
16
16
16
16
32
DQ0-DQ15,
DM
LDQS, UDQS
2
R
W
rite
F&
Drivers
Note:
This Functional Block Diagram is intended to facilitate user understanding of the operation of
the device; it does not represent an actual circuit implementation.
Note:
UDM and LDM are unidirectional signals (input only), but is internally loaded to match the
load of the bidirectional DQ , UDQS and LDQS signals.
Column
Decoder
(256
R
X
1
8
9
2
B
R
&
40
9
6
A
D
B
12
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| HYB25D256400AT-8 | ?256Mbit (64Mx4) DDR 200 (2-2-2) End-of-Life? |
| HYB25D256400BC-7 | ?256Mb (64Mx4) FBGA DDR266A (2-3-3)? |
| HYB25D256400BT-6 | ?256Mbit (64Mx4) DDR333 (2.5-3-3)? |
| HYB25D256400BT-7 | ?256Mbit (64Mx4) DDR266A (2-3-3)? |
| HYB25D256400BT-8 | ?256Mbit (64Mx4) DDR200 (2-2-2)? |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| HYB25D256400AT-8 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:?256Mbit (64Mx4) DDR 200 (2-2-2) End-of-Life? |
| HYB25D256400B | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:256 Mbit Double Data Rate SDRAM |
| HYB25D256400BC-5 | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:256 Mbit Double Data Rate SDRAM |
| HYB25D256400BC-6 | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:256 Mbit Double Data Rate SDRAM |
| HYB25D256400BC-7 | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:256-Mbit Double Data Rate SDRAM, Die Rev. B |
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