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參數(shù)資料
| 型號： | HY5V28CLF-H |
| 英文描述： | x8 SDRAM |
| 中文描述： | x8 SDRAM內(nèi)存 |
| 文件頁數(shù)： | 9/14頁 |
| 文件大?。?/td> | 72K |
| 代理商： | HY5V28CLF-H |
HY5V26C(L/S)F
Rev. 0.9/Oct. 01
10
AC CHARACTERISTICS II
Note :
1. A new command can be given tRRC after self refresh exit
Parameter
Symbol
-6
-K
-H
-8
-P
-S
Unit
Note
Min
Max
Min
Max
Min
Max
Min
Max
Min
Max
Min
Max
RAS Cycle Time
Operation
tRC
60
-
60
-
65
-
68
-
70
-
70
-
ns
Auto Refresh
tRRC
60
-
65
-
65
-
68
-
70
-
70
-
ns
RAS to CAS Delay
tRCD
18
-
15
-
20
-
20
-
20
-
20
-
ns
RAS Active Time
tRAS
42
100K
45
100K
45
100K
48
100K
50
100K
50
100K
ns
RAS Precharge Time
tRP
18
-
15
-
20
-
20
-
20
-
20
-
ns
RAS to RAS Bank Active Delay
tRRD
12
-
15
-
15
-
16
-
20
-
20
-
ns
CAS to CAS Delay
tCCD
1
-
1
-
1
-
1
-
1
-
1
-
CLK
Write Command to Data-In Delay
tWTL
0
-
0
-
0
-
0
-
0
-
0
-
CLK
Data-In to Precharge Command
tDPL
2
-
2
-
2
-
1
-
1
-
1
-
CLK
Data-In to Active Command
tDAL
5
-
4
-
5
-
4
-
3
-
3
-
CLK
DQM to Data-Out Hi-Z
tDQZ
2
-
2
-
2
-
2
-
2
-
2
-
CLK
DQM to Data-In Mask
tDQM
0
-
0
-
0
-
0
-
0
-
0
-
CLK
MRS to New Command
tMRD
2
-
2
-
2
-
2
-
2
-
2
-
CLK
Precharge to Data
Output Hi-Z
CAS Latency = 3
tPROZ3
3
-
3
-
3
-
3
-
3
-
3
-
CLK
CAS Latency = 2
tPROZ2
2
-
2
-
2
-
2
-
2
-
2
-
CLK
Power Down Exit Time
tPDE
1
-
1
-
1
-
1
-
1
-
1
-
CLK
Self Refresh Exit Time
tSRE
1
-
1
-
1
-
1
-
1
-
1
-
CLK
1
Refresh Time
tREF
-
64
-
64
-
64
-
64
-
64
-
64
ms
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| HY5V28CLF-K | x8 SDRAM |
| HY5V28CLF-P | x8 SDRAM |
| HY5V28CLF-S | x8 SDRAM |
| HY5V52CF | 8Mx32|3.3V|8K|H/8/P/S|SDR SDRAM - 256M |
| HY5V56BF | 16Mx16|3.3V|8K|H|SDR SDRAM - 256M |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| HY5V28CLF-K | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:x8 SDRAM |
| HY5V28CLF-P | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:x8 SDRAM |
| HY5V28CLF-S | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:x8 SDRAM |
| HY5V52CF | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8Mx32|3.3V|8K|H/8/P/S|SDR SDRAM - 256M |
| HY5V52CFP6 | 制造商:HYNIX 功能描述:Pb Free |
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