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參數(shù)資料
| 型號： | HM5225805BLTT-A6 |
| 廠商： | ELPIDA MEMORY INC |
| 元件分類： | DRAM |
| 英文描述： | 256M LVTTL interface SDRAM 133 MHz/100 MHz 4-Mword 】 16-bit 】 4-bank/8-Mword 】 8-bit 】 4-bank /16-Mword 】 4-bit 】 4-bank PC/133, PC/100 SDRAM |
| 中文描述： | 32M X 8 SYNCHRONOUS DRAM, 6 ns, PDSO54 |
| 封裝： | 0.400 INCH, PLASTIC, TSOP2-54 |
| 文件頁數(shù)： | 2/63頁 |
| 文件大?。?/td> | 462K |
| 代理商： | HM5225805BLTT-A6 |
第1頁當前第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁
HM5225165B/HM5225805B/HM5225405B-75/A6/B6
Data Sheet E0082H10
2
Byte control by DQM : DQM (HM5225805B/HM5225405B)
: DQMU/DQML (HM5225165B)
Refresh cycles: 8192 refresh cycles/64 ms
2 variations of refresh
Auto refresh
Self refresh
Ordering Information
Type No.
Frequency
CAS
latency
Package
HM5225165BTT-75*
1
HM5225165BTT-A6
HM5225165BTT-B6*
2
133 MHz
100 MHz
100 MHz
3
2/3
3
400-mil 54-pin plastic TSOP II (TTP-54D)
HM5225165BLTT-75*
1
HM5225165BLTT-A6
HM5225165BLTT-B6*
2
133 MHz
100 MHz
100 MHz
3
2/3
3
HM5225805BTT-75*
1
HM5225805BTT-A6
HM5225805BTT-B6*
2
133 MHz
100 MHz
100 MHz
3
2/3
3
HM5225805BLTT-75*
1
HM5225805BLTT-A6
HM5225805BLTT-B6*
2
133 MHz
100 MHz
100 MHz
3
2/3
3
HM5225405BTT-75*
1
HM5225405BTT-A6
HM5225405BTT-B6*
2
133 MHz
100 MHz
100 MHz
3
2/3
3
HM5225405BLTT-75*
1
HM5225405BLTT-A6
HM5225405BLTT-B6*
2
Notes: 1. 100 MHz operation at
CAS
latency = 2.
2. 66 MHz operation at
CAS
latency = 2.
133 MHz
100 MHz
100 MHz
3
2/3
3
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PDF描述 |
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