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參數(shù)資料
| 型號(hào)： | HI1171JCB |
| 廠商： | Intersil |
| 文件頁數(shù)： | 5/7頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DAC 8BIT 40MSPS HS 24-SOIC |
| 標(biāo)準(zhǔn)包裝： | 300 |
| 設(shè)置時(shí)間： | 10ns |
| 位數(shù)： | 8 |
| 數(shù)據(jù)接口： | 并聯(lián) |
| 轉(zhuǎn)換器數(shù)目： | 1 |
| 電壓電源： | 模擬和數(shù)字 |
| 功率耗散（最大）： | 80mW |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 24-SOIC（0.209"，5.30mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 24-SOIC W |
| 包裝： | 管件 |
| 輸出數(shù)目和類型： | 2 電流，單極 |
| 采樣率（每秒）： | 40M |
5
Typical Performance Curves
FIGURE 2. OUTPUT FULL SCALE VOLTAGE vs REFERENCE
VOLTAGE
FIGURE 3. OUTPUT RESISTANCE vs GLITCH ENERGY
FIGURE 4. OUTPUT FULL SCALE VOLTAGE vs AMBIENT TEMPERATURE
Pin Descriptions
24 PIN
SOIC
PIN
NAME
PIN DESCRIPTION
1-8
D0(LSB) thru
D7(MSB)
Digital Data Bit 0, the Least Significant Bit thru Digital Data Bit 7, the Most Significant Bit.
9
BLNK
Blanking Line, used to clear the internal data register to the zero condition when High, normal operation
when Low.
10, 13
DVSS
Digital Ground.
11
VB
Voltage Bias, connect a 0.1
F capacitor to DV
SS.
12
CLK
Data Clock Pin 100kHz to 40MHz.
14
AVSS
Analog Ground.
15
IREF
Current Reference, used to set the current range. Connect a resistor to AVSS that is 16 times greater
than the resistor on IOUT1. (See Typical Applications Circuit).
16
VREF
Input Reference Voltage used to set the output full scale range.
2
1
12
VDD = 5.0V, R = 200
16R = 3.3k
, TA = 25oC
O
U
TPUT
F
U
LL
SCAL
E
VO
LTAG
E
(V)
REFERENCE VOLTAGE (V)
100
200
100
200
OUTPUT RESISTANCE (
)
GL
ITCH
EN
ERG
Y
(p
V
/s
)
2.0
1.9
0
-25
0
25
50
75
VDD = 5.0V, VREF = 2.0V
R = 200
, 16R = 3.3k
TA = 25
oC
O
U
TPUT
FU
LL
SCALE
VO
LTAG
E
(V)
AMBIENT TEMPERATURE (oC)
HI1171
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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