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參數資料
| 型號： | HEF4006B |
| 廠商： | NXP Semiconductors N.V. |
| 英文描述： | 18-stage static shift register |
| 中文描述： | 18級靜態(tài)移位寄存器 |
| 文件頁數： | 4/5頁 |
| 文件大?。?/td> | 53K |
| 代理商： | HEF4006B |
January 1995
4
Philips Semiconductors
Product specification
18-stage static shift register
HEF4006B
MSI
AC CHARACTERISTICS
V
SS
= 0 V; T
amb
= 25
°
C; C
L
= 50 pF; input transition times
≤
20 ns
V
DD
V
SYMBOL
MIN
TYP
MAX
TYPICAL EXTRAPOLATION
FORMULA
Propagation delays
CP
→
O
n
HIGH to LOW
5
90
40
30
90
40
35
60
30
20
60
30
20
30
20
15
10
5
0
5
180
80
60
180
85
70
120
60
40
120
60
40
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
MHz
MHz
MHz
63 ns
+
(0,55 ns/pF) C
L
29 ns
+
(0,23 ns/pF) C
L
22 ns
+
(0,16 ns/pF) C
L
63 ns
+
(0,55 ns/pF) C
L
29 ns
+
(0,23 ns/pF) C
L
27 ns
+
(0,16 ns/pF) C
L
10 ns
+
(1,0 ns/pF) C
L
9 ns
+
(0,42 ns/pF) C
L
6 ns
+
(0,28 ns/pF) C
L
10 ns
+
(1,0 ns/pF) C
L
9 ns
+
(0,42 ns/pF) C
L
6 ns
+
(0,28 ns/pF) C
L
10
15
5
10
15
5
10
15
5
10
15
5
10
15
5
10
15
5
10
15
5
10
15
t
PHL
LOW to HIGH
t
PLH
Output transition times
HIGH to LOW
t
THL
LOW to HIGH
t
TLH
Minimum clock
pulse width; HIGH
60
40
30
20
10
5
see also waveforms Fig.4
t
WCPH
Set-up time
D
n
→
CP
t
su
Hold time
D
n
→
CP
5
5
5
9
t
hold
0
0
Maximum clock
pulse frequency
18
30
36
f
max
15
18
V
DD
V
TYPICAL FORMULA FOR P (
μ
W)
Dynamic power
dissipation per
package (P)
5
600 f
i
+ ∑
(f
o
C
L
)
×
V
DD2
3200 f
i
+ ∑
(f
o
C
L
)
×
V
DD2
11 600 f
i
+ ∑
(f
o
C
L
)
×
V
DD2
where
f
i
= input freq. (MHz)
f
o
= output freq. (MHz)
C
L
= load capacitance (pF)
∑
(f
o
C
L
) = sum of outputs
V
DD
= supply voltage (V)
10
15
相關PDF資料 |
PDF描述 |
|---|---|
| HEF4006BD | 18-stage static shift register |
| HEF4006BF | 18-stage static shift register |
| HEF4006BN | 18-stage static shift register |
| HEF4006BP | 18-stage static shift register |
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相關代理商/技術參數 |
參數描述 |
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