參數(shù)資料
型號(hào)： HEC4060BT
廠商： NXP Semiconductors N.V.
元件分類： 通用總線功能
英文描述： 14-stage ripple-carry binary counter-divider and oscillator
封裝： HEC4060BT<SOT109-1 (SO16)|<<http://www.nxp.com/packages/SOT109-1.html<1<week 6, 2004,;HEC4060BT<SOT109-1 (SO16)|<<http://www.nxp.com/packages/SOT109-1.html<1<week 6
文件頁(yè)數(shù)： 4/7頁(yè)
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代理商： HEC4060BT
January 1995
4
Philips Semiconductors
Product specification
14-stage ripple-carry binary counter/divider
and oscillator
HEF4060B
MSI
AC CHARACTERISTICS
V
SS
= 0 V; T
amb
= 25
°
C; C
L
= 50 pF; input transition times
≤
20 ns
V
DD
V
SYMBOL
MIN.
TYP.
MAX.
TYPICAL EXTRAPOLATION
FORMULA
Propagation delays
RS
→
O
3
HIGH to LOW
5
210
80
50
210
80
50
25
10
420
160
100
420
160
100
50
20
12
50
20
12
200
80
60
120
60
40
120
60
40
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
MHz
MHz
MHz
183 ns
+
(0,55 ns/pF) C
L
69 ns
+
(0,23 ns/pF) C
L
42 ns
+
(0,16 ns/pF) C
L
183 ns
+
(0,55 ns/pF) C
L
69 ns
+
(0,23 ns/pF) C
L
42 ns
+
(0,16 ns/pF) C
L
10
15
5
10
15
5
10
15
5
10
15
5
10
15
5
10
15
5
10
15
5
10
15
5
10
15
t
PHL
LOW to HIGH
t
PLH
O
n
→
O
n
+
1
HIGH to LOW
t
PHL
6
25
10
LOW to HIGH
t
PLH
6
MR
→
O
n
HIGH to LOW
100
40
30
60
30
20
60
30
20
60
25
15
25
15
10
80
40
30
73 ns
+
(0,55 ns/pF) C
L
29 ns
+
(0,23 ns/pF) C
L
22 ns
+
(0,16 ns/pF) C
L
10 ns
+
(1,0 ns/pF) C
L
9 ns
+
(0,42 ns/pF) C
L
6 ns
+
(0,28 ns/pF) C
L
10 ns
+
(1,0 ns/pF) C
L
9 ns
+
(0,42 ns/pF) C
L
6 ns
+
(0,28 ns/pF) C
L
t
PHL
Output transition
times
HIGH to LOW
t
THL
LOW to HIGH
t
TLH
Minimum clock pulse
width input RS
HIGH
Minimum MR pulse
width; HIGH
120
50
30
50
30
20
160
80
60
t
WRSH
t
WMRH
Recovery time
for MR
5
10
15
t
RMR
Maximum clock pulse
frequency input RS
5
4
8
10
15
f
max
10
15
20
30
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