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參數(shù)資料
| 型號： | GS88136AT-133 |
| 廠商： | GSI TECHNOLOGY |
| 元件分類： | DRAM |
| 英文描述： | 512K x 18, 256K x 36 9Mb Synchronous Burst SRAMs |
| 中文描述： | 256K X 36 CACHE SRAM, 8.5 ns, PQFP100 |
| 封裝： | TQFP-100 |
| 文件頁數(shù)： | 10/36頁 |
| 文件大?。?/td> | 606K |
| 代理商： | GS88136AT-133 |
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GS88118A(T/D)/GS88132A(D)/GS88136A(T/D)
Specifications cited are subject to change without notice. For latest documentation see http://www.gsitechnology.com.
Rev: 1.04 3/2005
10/36
2001, GSI Technology
Mode Pin Functions
Note:
There is a pull-up device onthe FT pin and a pull-down device on the ZZ pin, so those input pins can be unconnected and the chip will operate
in the default states as specified in the above tables.
Burst Counter Sequences
BPR 1999.05.18
Mode Name
Pin Name
State
L
H
L
H or NC
L or NC
Function
Linear Burst
Interleaved Burst
Flow Through
Pipeline
Active
Standby, I
DD
= I
SB
Burst Order Control
LBO
Output Register Control
FT
Power Down Control
ZZ
H
Note:
The burst counter wraps to initial state on the 5th clock.
Note:
The burst counter wraps to initial state on the 5th clock.
Linear Burst Sequence
A[1:0] A[1:0] A[1:0] A[1:0]
1st address
00
01
10
11
2nd address
01
10
11
00
3rd address
10
11
00
01
4th address
11
00
01
10
Interleaved Burst Sequence
A[1:0] A[1:0] A[1:0] A[1:0]
1st address
00
01
10
11
2nd address
01
00
11
10
3rd address
10
11
00
01
4th address
11
10
01
00
相關PDF資料 |
PDF描述 |
|---|---|
| GS88136AT-133I | 512K x 18, 256K x 36 9Mb Synchronous Burst SRAMs |
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相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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