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參數(shù)資料
| 型號(hào)： | EP1S20F780I6N |
| 廠商： | Altera |
| 文件頁(yè)數(shù)： | 319/864頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC STRATIX FPGA 20K LE 780-FBGA |
| 產(chǎn)品培訓(xùn)模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 標(biāo)準(zhǔn)包裝： | 18 |
| 系列： | Stratix® |
| LAB/CLB數(shù)： | 1846 |
| 邏輯元件/單元數(shù)： | 18460 |
| RAM 位總計(jì)： | 1669248 |
| 輸入/輸出數(shù)： | 586 |
| 電源電壓： | 1.425 V ~ 1.575 V |
| 安裝類(lèi)型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 100°C |
| 封裝/外殼： | 780-BBGA |
| 供應(yīng)商設(shè)備封裝： | 780-FBGA（29x29） |
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2–18
Altera Corporation
Stratix Device Handbook, Volume 2
July 2005
Clock Modes
Input/Output Clock Mode
The TriMatrix memory blocks can implement input/output clock mode
for true and simple dual-port memory. On each of the two ports, A and B,
one clock controls all registers for inputs into the memory block: data
input, wren, and address. The other clock controls the block’s data output
registers. Each memory block port also supports independent clock
enables and asynchronous clear signals for input and output registers.
Figures 2–10 and 2–11 show the memory block in input/output clock
mode for true and simple dual-port modes, respectively.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| BR24L08F-WE2 | IC EEPROM 8KBIT 400KHZ 8SOP |
| ACB92DHRN-S378 | EDGECARD EXT PCI64 184POS 5V |
| EP1S20F780C5N | IC STRATIX FPGA 20K LE 780-FBGA |
| A1460A-1PQ160C | IC FPGA 6K GATES 160-PQFP |
| ABB92DHRN-S378 | CONN EDGECARD PCI64 184PS .05 5V |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| EP1S25 | 制造商:ALTERA 制造商全稱(chēng):Altera Corporation 功能描述:Stratix Device Family Data Sheet |
| EP1S25B1508C5ES | 制造商:ALTERA 制造商全稱(chēng):Altera Corporation 功能描述:Stratix Device Family Data Sheet |
| EP1S25B1508C6ES | 制造商:ALTERA 制造商全稱(chēng):Altera Corporation 功能描述:Stratix Device Family Data Sheet |
| EP1S25B1508C7ES | 制造商:ALTERA 制造商全稱(chēng):Altera Corporation 功能描述:Stratix Device Family Data Sheet |
| EP1S25B1508I5ES | 制造商:ALTERA 制造商全稱(chēng):Altera Corporation 功能描述:Stratix Device Family Data Sheet |
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