參數(shù)資料
型號(hào)： FR65E
廠商： Fujitsu Limited
英文描述： 32-Bit Microcontroller
中文描述： 32位微控制器
文件頁數(shù)： 20/87頁
文件大小： 369K
代理商： FR65E
MB91307B
20
2.
Internal Architecture
The FR series CPU uses a Harvard architecture with independent instruction bus and data bus. The instruction
bus (I-BUS) is connected to an on-chip instruction cache. a 32-bit
←→
16-bit bus converter is connected to the
bus (F-BUS) to provide an interface between the CPU and peripheral resources. The Harvard
←→
Princeton
bus converter is connected to the both the I-BUS and D-BUS as an interface between the CPU and bus controller.
Internal Architecture
FRex CPU
D bus
Instruction
cache
I address
I data
D address
32
32
32
32
32
32
16
R-bus
X-bus
D data
F address
F data
RAM
32 bit
16 bit
Bus converter
Princeton
bus
converter
Harvard
Bus controller
Peripherals resource
I bus
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PDF描述
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