tACO1 Array clock to output " />
參數(shù)資料
型號： EPM7064LC84-10
廠商： Altera
文件頁數(shù)： 37/66頁
文件大小： 0K
描述： IC MAX 7000 CPLD 64 84-PLCC
標(biāo)準(zhǔn)包裝： 75
系列： MAX® 7000
可編程類型： 系統(tǒng)內(nèi)可編程
最大延遲時間 tpd(1)： 10.0ns
電壓電源 - 內(nèi)部： 4.75 V ~ 5.25 V
邏輯元件/邏輯塊數(shù)目： 4
宏單元數(shù)： 64
門數(shù)： 1250
輸入/輸出數(shù)： 68
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 84-LCC（J 形引線）
供應(yīng)商設(shè)備封裝： 84-PLCC（29.31x29.31）
包裝： 管件
其它名稱： 544-2304-5
42
Altera Corporation
MAX 7000 Programmable Logic Device Family Data Sheet
tACO1
Array clock to output delay
C1 = 35 pF
5.4
6.7
7.5
10.0
ns
tACH
Array clock high time
2.5
3.0
4.0
ns
tACL
Array clock low time
2.5
3.0
4.0
ns
tCPPW
Minimum pulse width for clear
and preset
2.5
3.0
4.0
ns
tODH
Output data hold time after
clock
C1 = 35 pF (3)
1.0
ns
tCNT
Minimum global clock period
5.7
7.1
8.0
10.0
ns
fCNT
Maximum internal global clock
frequency
175.4
140.8
125.0
100.0
MHz
tACNT
Minimum array clock period
5.7
7.1
8.0
10.0
ns
fACNT
Maximum internal array clock
frequency
175.4
140.8
125.0
100.0
MHz
fMAX
Maximum clock frequency
250.0
200.0
166.7
125.0
MHz
Table 30. EPM7064S Internal Timing Parameters (Part 1 of 2)
Symbol
Parameter
Conditions
Speed Grade
Unit
-5
-6
-7
-10
Min
Max
Min
Max
Min
Max
Min
Max
tIN
Input pad and buffer delay
0.2
0.5
ns
tIO
I/O input pad and buffer delay
0.2
0.5
ns
tFIN
Fast input delay
2.2
2.6
1.0
ns
tSEXP
Shared expander delay
3.1
3.8
4.0
5.0
ns
tPEXP
Parallel expander delay
0.9
1.1
0.8
ns
tLAD
Logic array delay
2.6
3.2
3.0
5.0
ns
tLAC
Logic control array delay
2.5
3.2
3.0
5.0
ns
tIOE
Internal output enable delay
0.7
0.8
2.0
ns
tOD1
Output buffer and pad delay
C1 = 35 pF
0.2
0.3
2.0
1.5
ns
tOD2
Output buffer and pad delay
C1 = 35 pF (6)
0.7
0.8
2.5
2.0
ns
tOD3
Output buffer and pad delay
C1 = 35 pF
5.2
5.3
7.0
5.5
ns
tZX1
Output buffer enable delay
C1 = 35 pF
4.0
5.0
ns
tZX2
Output buffer enable delay
C1 = 35 pF (6)
4.5
5.5
ns
tZX3
Output buffer enable delay
C1 = 35 pF
9.0
ns
tXZ
Output buffer disable delay
C1 = 5 pF
4.0
5.0
ns
tSU
Register setup time
0.8
1.0
3.0
2.0
ns
tH
Register hold time
1.7
2.0
3.0
ns
Table 29. EPM7064S External Timing Parameters (Part 2 of 2)
Note (1)
Symbol
Parameter
Conditions
Speed Grade
Unit
-5
-6
-7
-10
MinMax MinMax MinMax MinMax
相關(guān)PDF資料
PDF描述
MAX6510HAUT+T IC TEMP SWITCH PROG SOT23-6
VE-24P-CY-F3 CONVERTER MOD DC/DC 13.8V 50W
S332M47X7RN6BJ0R CAP CER 3300PF 1KV 20% RADIAL
VE-24N-CY-F4 CONVERTER MOD DC/DC 18.5V 50W
UWS-5/10-Q48NM-C DC/DC CONVERTER 5V 10A ISOLATED
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
EPM7064LC84-10YY 制造商:Altera Corporation 功能描述:CPLD MAX 7000 Family 1.25K Gates 64 Macro Cells 100MHz CMOS Technology 5V 84-Pin PLCC
EPM7064LC84-12 功能描述:CPLD - 復(fù)雜可編程邏輯器件 CPLD - MAX 7000 64 Macro 68 IOs RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100
EPM7064LC84-15 功能描述:CPLD - 復(fù)雜可編程邏輯器件 CPLD - MAX 7000 64 Macro 68 IOs RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100
EPM7064LC847 制造商:ALT 功能描述:ALTERA S9K3A 制造商:ALTERA 功能描述:New
EPM7064LC84-7 功能描述:CPLD - 復(fù)雜可編程邏輯器件 CPLD - MAX 7000 64 Macro 68 IOs RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100
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