參數(shù)資料
型號(hào)： EPM3512AQC208-7N
廠商： Altera
文件頁(yè)數(shù)： 7/46頁(yè)
文件大?。?/td> 0K
描述： IC MAX 3000A CPLD 512 208-PQFP
標(biāo)準(zhǔn)包裝： 72
系列： MAX® 3000A
可編程類型： 系統(tǒng)內(nèi)可編程
最大延遲時(shí)間 tpd(1)： 7.5ns
電壓電源 - 內(nèi)部： 3 V ~ 3.6 V
邏輯元件/邏輯塊數(shù)目： 32
宏單元數(shù)： 512
門(mén)數(shù)： 10000
輸入/輸出數(shù)： 172
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 208-BFQFP
供應(yīng)商設(shè)備封裝： 208-PQFP（28x28）
包裝： 托盤(pán)
Altera Corporation
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MAX 3000A Programmable Logic Device Family Data Sheet
By combining the pulse and shift times for each of the programming
stages, the program or verify time can be derived as a function of the TCK
frequency, the number of devices, and specific target device(s). Because
different ISP-capable devices have a different number of EEPROM cells,
both the total fixed and total variable times are unique for a single device.
Programming a Single MAX 3000A Device
The time required to program a single MAX 3000A device in-system can
be calculated from the following formula:
where: tPROG
= Programming time
tPPULSE
= Sum of the fixed times to erase, program, and
verify the EEPROM cells
CyclePTCK = Number of TCK cycles to program a device
fTCK
= TCK frequency
The ISP times for a stand-alone verification of a single MAX 3000A device
can be calculated from the following formula:
where: tVER
=Verify time
tVPULSE
= Sum of the fixed times to verify the EEPROM cells
CycleVTCK = Number of TCK cycles to verify a device
tPROG
tPPULSE
Cycle
PTCK
f
TCK
--------------------------------
+
=
tVER
tVPULSE
Cycle
VTCK
fTCK
--------------------------------
+
=
相關(guān)PDF資料
PDF描述
HBC50DREN-S734 CONN EDGECARD 100PS .100 EYELET
ISL61862HIRZ-T IC USB PWR CTRLR 3A 8DFN
4-641284-8 18 CIR MTA 156 EDG/CON F/T LF
EPM3512AQC208-7 IC MAX 3000A CPLD 512 208-PQFP
ISL61862HIRZ IC USB PWR CTRLR 3A 8DFN
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參數(shù)描述
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