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參數(shù)資料
型號： EPM3256AQI208-10
廠商： Altera
文件頁數(shù)： 42/46頁
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描述： IC MAX 3000A CPLD 256 208-PQFP
標(biāo)準(zhǔn)包裝： 72
系列： MAX® 3000A
可編程類型： 系統(tǒng)內(nèi)可編程
最大延遲時間 tpd(1)： 10.0ns
電壓電源 - 內(nèi)部： 3 V ~ 3.6 V
邏輯元件/邏輯塊數(shù)目： 16
宏單元數(shù)： 256
門數(shù)： 5000
輸入/輸出數(shù)： 158
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 208-BFQFP
供應(yīng)商設(shè)備封裝： 208-PQFP（28x28）
包裝： 托盤
Altera Corporation
5
MAX 3000A Programmable Logic Device Family Data Sheet
Figure 1. MAX 3000A Device Block Diagram
Note:
(1)
EPM3032A, EPM3064A, EPM3128A, and EPM3256A devices have six output enables. EPM3512A devices have
10 output enables.
Logic Array Blocks
The MAX 3000A device architecture is based on the linking of
high–performance LABs. LABs consist of 16–macrocell arrays, as shown
in Figure 1. Multiple LABs are linked together via the PIA, a global bus
that is fed by all dedicated input pins, I/O pins, and macrocells.
Each LAB is fed by the following signals:
■
36 signals from the PIA that are used for general logic inputs
■
Global controls that are used for secondary register functions
6 or 10
INPUT/GCLRn
6 or 10 Output Enables (1)
16
36
16
I/O
Control
Block
LAB C
LAB D
I/O
Control
Block
6 or 10
16
36
16
I/O
Control
Block
LAB A
Macrocells
1 to 16
LAB B
I/O
Control
Block
6 or 10
PIA
INPUT/GCLK1
INPUT/OE2/GCLK2
INPUT/OE1
2 to 16 I/O
2 to
16
2 to
16
2 to
16
2 to
16
2 to 16
Macrocells
17 to 32
Macrocells
33 to 48
Macrocells
49 to 64
相關(guān)PDF資料
PDF描述
180-M62-203L031 CONN DB62 FMAL HD SLD CUP NICKEL
AYM24DTAS CONN EDGECARD 48POS R/A .156 SLD
R05P23.3S/R8 CONV DC/DC 2W 05VIN 3.3VOUT
VE-20M-CY-F1 CONVERTER MOD DC/DC 10V 50W
R05P23.3S/P/R6.4 CONV DC/DC 2W 05VIN 3.3VOUT
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參數(shù)描述
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