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參數資料
型號： EPM3128ATC100-10
廠商： Altera
文件頁數： 42/46頁
文件大?。?/td> 0K
描述： IC MAX 3000A CPLD 128 100-TQFP
產品變化通告： Bond Wire Change 4/Sept/2008
標準包裝： 270
系列： MAX® 3000A
可編程類型： 系統(tǒng)內可編程
最大延遲時間 tpd(1)： 10.0ns
電壓電源 - 內部： 3 V ~ 3.6 V
邏輯元件/邏輯塊數目： 8
宏單元數： 128
門數： 2500
輸入/輸出數： 80
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 100-TQFP
供應商設備封裝： 100-TQFP（14x14）
包裝： 托盤
產品目錄頁面： 603 (CN2011-ZH PDF)
其它名稱： 544-1163
Altera Corporation
5
MAX 3000A Programmable Logic Device Family Data Sheet
Figure 1. MAX 3000A Device Block Diagram
Note:
(1)
EPM3032A, EPM3064A, EPM3128A, and EPM3256A devices have six output enables. EPM3512A devices have
10 output enables.
Logic Array Blocks
The MAX 3000A device architecture is based on the linking of
high–performance LABs. LABs consist of 16–macrocell arrays, as shown
in Figure 1. Multiple LABs are linked together via the PIA, a global bus
that is fed by all dedicated input pins, I/O pins, and macrocells.
Each LAB is fed by the following signals:
■
36 signals from the PIA that are used for general logic inputs
■
Global controls that are used for secondary register functions
6 or 10
INPUT/GCLRn
6 or 10 Output Enables (1)
16
36
16
I/O
Control
Block
LAB C
LAB D
I/O
Control
Block
6 or 10
16
36
16
I/O
Control
Block
LAB A
Macrocells
1 to 16
LAB B
I/O
Control
Block
6 or 10
PIA
INPUT/GCLK1
INPUT/OE2/GCLK2
INPUT/OE1
2 to 16 I/O
2 to
16
2 to
16
2 to
16
2 to
16
2 to 16
Macrocells
17 to 32
Macrocells
33 to 48
Macrocells
49 to 64
相關PDF資料
PDF描述
RSM43DRSD-S288 CONN EDGECARD 86POS DIP .156 SLD
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EPM240F100I5N IC MAX II CPLD 240 LE 100-FBGA
EPM240F100C4N IC MAX II CPLD 240 LE 100-FBGA
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