參數(shù)資料
型號： EPM3032ALC44-7
廠商： Altera
文件頁數(shù)： 3/46頁
文件大小： 0K
描述： IC MAX 3000A CPLD 32 44-PLCC
標準包裝： 390
系列： MAX® 3000A
可編程類型： 系統(tǒng)內可編程
最大延遲時間 tpd(1)： 7.5ns
電壓電源 - 內部： 3 V ~ 3.6 V
邏輯元件/邏輯塊數(shù)目： 2
宏單元數(shù)： 32
門數(shù)： 600
輸入/輸出數(shù)： 34
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 44-LCC（J 形引線）
供應商設備封裝： 44-PLCC（16.58x16.58）
包裝： 管件
Altera Corporation
11
MAX 3000A Programmable Logic Device Family Data Sheet
Figure 5. MAX 3000A PIA Routing
While the routing delays of channel–based routing schemes in masked or
FPGAs are cumulative, variable, and path–dependent, the MAX 3000A
PIA has a predictable delay. The PIA makes a design’s timing
performance easy to predict.
I/O Control Blocks
The I/O control block allows each I/O pin to be individually configured
for input, output, or bidirectional operation. All I/O pins have a tri–state
buffer that is individually controlled by one of the global output enable
signals or directly connected to ground or VCC. Figure 6 shows the I/O
control block for MAX 3000A devices. The I/O control block has 6 or
10 global output enable signals that are driven by the true or complement
of two output enable signals, a subset of the I/O pins, or a subset of the
I/O macrocells.
To LAB
PIA Signals
相關PDF資料
PDF描述
RPE5C2A3R0C2P1B03B CAP CER 3PF 100V RADIAL
EMA49DTBI CONN EDGECARD 98POS R/A .125 SLD
GCC25DCMN CONN EDGECARD 50POS .100" WW
ESA49DTAI CONN EDGECARD 98POS R/A .125 SLD
GCC12DRTI CONN EDGECARD 24POS DIP .100 SLD
相關代理商/技術參數(shù)
參數(shù)描述
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EPM3032ALI44-10N 功能描述:CPLD - 復雜可編程邏輯器件 CPLD - MAX 3000A 32 Macro 34 IOs RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100
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EPM3032ATC4410 制造商:ALTERA 功能描述:New 制造商:Altera Corporation 功能描述:
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