參數(shù)資料
型號： EPM3032ALC44-10
英文描述： Electrically-Erasable Complex PLD
中文描述： 電可擦除復雜可編程邏輯器件
文件頁數(shù)： 23/53頁
文件大小： 839K
代理商： EPM3032ALC44-10
Altera Corporation
3
MAX 3000A Programmable Logic Device Family Data Sheet
Note:
(1)
Contact Altera for up-to-date information on the availability of this speed grade.
The MAX 3000A architecture supports 100% transistor-to-transistor logic
(TTL) emulation and high-density small-scale integration (SSI),
medium-scale integration (MSI), and large-scale integration (LSI) logic
functions. The MAX 3000A architecture easily integrates multiple devices
ranging from PALs, GALs, and 22V10s to MACH, and pLSI devices.
MAX 3000A devices are available in a wide range of packages, including
PLCC, PQFP, and TQFP packages. See Table 3.
Notes:
(1)
Contact Altera for up-to-date information on available device package options.
(2)
When the IEEE Std. 1149.1 (JTAG) interface is used for in-system programming or
boundary-scan testing, four I/O pins become JTAG pins.
MAX 3000A devices use CMOS EEPROM cells to implement logic
functions. The user-configurable MAX 3000A architecture accommodates
a variety of independent combinatorial and sequential logic functions.
The devices can be reprogrammed for quick and efficient iterations
during design development and debug cycles, and can be programmed
and erased up to 100 times.
Table 2. MAX 3000A Speed Grades
Device
Speed Grade
-4
-5
-6
-7
-10
EPM3032A
vv
v
EPM3064A
vv
v
EPM3128A
vv
v
EPM3256A
v (1)
vv
Table 3. MAX 3000A Maximum User I/O Pins
Device
44-Pin
PLCC
44-Pin
TQFP
100-Pin
TQFP
144-Pin
TQFP
208-Pin
PQFP
EPM3032A
34
EPM3064A
34
66
EPM3128A
80
96
EPM3256A
116
158
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PDF描述
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EPM3032ATC44-10
EPM3064ATC44-4
EPM3064ATC44-7 Electrically-Erasable Complex PLD
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