參數資料
型號： EPF10K130E
廠商： Altera Corporation
英文描述： Embedded Programmable Logic Family(FLEX10KE嵌入式可編程邏輯系列)
中文描述： 嵌入式可編程邏輯系列（FLEX10KE嵌入式可編程邏輯系列）
文件頁數： 1/121頁
文件大小： 2001K
代理商： EPF10K130E
Altera Corporation
1
FLEX 10KE
Embedded Programmable
Logic Family
August 1999, ver. 2.02
Data Sheet
A-DS-F10KE-02.02
Features...
I
Embedded programmable logic devices (PLDs), providing
System-on-a-Programmable-Chip
TM
integration in a single device
–
Enhanced embedded array for implementing megafunctions
such as efficient memory and specialized logic functions
–
Dual-port capability with up to 16-bit width per embedded array
block (EAB)
–
Logic array for general logic functions
High density
–
30,000 to 200,000 typical gates (see
Tables 1
and
2
)
–
Up to 98,304 RAM bits; 4,096 bits per EAB, all of which can be
used without reducing logic capacity
System-level features
–
MultiVolt
TM
I/O pins can drive or be driven by 2.5-V, 3.3-V, or
5.0-V devices
–
Low power consumption
–
Bidirectional I/O performance (
t
SU
and
t
CO
) up to 250 MHz
–
Fully compliant with the peripheral component interconnect
Special Interest Group (PCI SIG)
PCI Local Bus Specification,
Revision 2.2
for 3.3-V operation at 33 MHz or 66 MHz
–
-1 speed grade devices are compliant with
PCI Local Bus
Specification, Revision 2.2
, for 5.0-V operation
–
Built-in Joint Test Action Group (JTAG) boundary-scan test
(BST) circuitry compliant with IEEE Std. 1149.1-1990, available
without consuming additional device logic
Preliminary
Information
I
I
f
For information on 5.0-V FLEX 10K or 3.3-V FLEX 10KA devices, see the
FLEX 10K Embedded Programmable Logic Family Data Sheet
.
Table 1. FLEX 10KE Device Features
Feature
EPF10K30E
EPF10K50E
EPF10K50S
EPF10K100B
Typical gates
Maximum system gates
Logic elements (LEs)
EABs
Total RAM bits
Maximum user I/O pins
(1)
30,000
119,000
1,728
6
24,576
220
50,000
199,000
2,880
10
40,960
254
100,000
158,000
4,992
12
24,576
191
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