參數(shù)資料
型號(hào)： EPC8QI100N
廠商： Altera
文件頁(yè)數(shù)： 21/36頁(yè)
文件大?。?/td> 0K
描述： IC CONFIG DEVICE 8MBIT 100-PQFP
產(chǎn)品培訓(xùn)模塊： Three Reasons to Use FPGA's in Industrial Designs
標(biāo)準(zhǔn)包裝： 66
系列： EPC
可編程類(lèi)型： 系統(tǒng)內(nèi)可編程
存儲(chǔ)容量： 8Mb
電源電壓： 3 V ~ 3.6 V
工作溫度： -40°C ~ 85°C
封裝/外殼： 100-BQFP
供應(yīng)商設(shè)備封裝： 100-PQFP（14x20）
包裝： 托盤(pán)
其它名稱： 544-1682
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IEEE Std. 1149.1 (JTAG) Boundary-Scan
Enhanced Configuration (EPC) Devices Datasheet
January 2012
Altera Corporation
You can also program the EPC devices using the Quartus II software, the Altera
Programming Unit (APU), and the appropriate configuration device programming
adapter. Table 12 lists which programming adapter to use with each EPC device.
IEEE Std. 1149.1 (JTAG) Boundary-Scan
The EPC device provides JTAG BST circuitry that complies with the IEEE Std.
1149.1-1990 specification. JTAG BST can be performed before or after configuration,
but not during configuration.
Figure 6 shows the timing requirements for the JTAG signals.
Table 13 lists the timing parameters and values for the EPC device.
Table 12. Programming Adapters
Device
Package
Adapter
EPC16
88-pin UFBGA
PLMUEPC-88
100-pin PQFP
PLMQEPC-100
EPC8
100-pin PQFP
PLMQEPC-100
EPC4
100-pin PQFP
PLMQEPC-100
Figure 6. JTAG Timing Waveforms
TDO
TCK
tJPZX
tJPCO
tJPH
tJPXZ
tJCP
tJPSU
tJCL
tJCH
TDI
TMS
Signal
to be
Captured
Signal
to be
Driven
tJSZX
tJSSU
tJSH
tJSCO
tJSXZ
Table 13. JTAG Timing Parameters and Values (Part 1 of 2)
Symbol
Parameter
Min
Max
Unit
tJCP
TCK
clock period
100
—
ns
tJCH
TCK
clock high time
50
—
ns
tJCL
TCK
clock low time
50
—
ns
tJPSU
JTAG port setup time
20
—
ns
tJPH
JTAG port hold time
45
—
ns
tJPCO
JTAG port clock output
—
25
ns
tJPZX
JTAG port high impedance to valid output
—
25
ns
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