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    參數(shù)資料
    型號: EP4SE820F43C4
    廠商: Altera
    文件頁數(shù): 14/82頁
    文件大小: 0K
    描述: IC STRATIX IV FPGA 820K 1760FBGA
    產(chǎn)品培訓模塊: Three Reasons to Use FPGA's in Industrial Designs
    標準包裝: 3
    系列: STRATIX® IV E
    LAB/CLB數(shù): 32522
    邏輯元件/單元數(shù): 813050
    RAM 位總計: 34093056
    輸入/輸出數(shù): 1120
    電源電壓: 0.87 V ~ 0.93 V
    安裝類型: 表面貼裝
    工作溫度: 0°C ~ 85°C
    封裝/外殼: 1760-BBGA,F(xiàn)CBGA
    供應商設備封裝: 1760-FCBGA
    Chapter 1: DC and Switching Characteristics for Stratix IV Devices
    1–13
    Electrical Characteristics
    March 2014
    Altera Corporation
    Stratix IV Device Handbook
    Volume 4: Device Datasheet and Addendum
    Table 1–19. Single-Ended SSTL and HSTL I/O Standards Signal Specifications
    I/O Standard
    VIL(DC) (V)
    VIH(DC) (V)
    VIL(AC)
    (V)
    VIH(AC)
    (V)
    VOL (V)
    VOH (V)
    Iol (mA)
    Ioh (mA)
    Min
    Max
    Min
    Max
    Min
    Max
    Min
    SSTL-2
    Class I
    -0.3
    VREF -
    0.15
    VREF +
    0.15
    VCCIO +
    0.3
    VREF -
    0.31
    VREF +
    0.31
    VTT -
    0.57
    VTT +
    0.57
    8.1
    -8.1
    SSTL-2
    Class II
    -0.3
    VREF -
    0.15
    VREF +
    0.15
    VCCIO +
    0.3
    VREF -
    0.31
    VREF +
    0.31
    VTT -
    0.76
    VTT +
    0.76
    16.2
    -16.2
    SSTL-18
    Class I
    -0.3
    VREF -
    0.125
    VREF +
    0.125
    VCCIO +
    0.3
    VREF -
    0.25
    VREF +
    0.25
    VTT -
    0.475
    VTT +
    0.475
    6.7
    -6.7
    SSTL-18
    Class II
    -0.3
    VREF -
    0.125
    VREF +
    0.125
    VCCIO +
    0.3
    VREF -
    0.25
    VREF +
    0.25
    0.28
    VCCIO -
    0.28
    13.4
    -13.4
    SSTL-15
    Class I
    VREF -
    0.1
    VREF +
    0.1
    VREF -
    0.175
    VREF +
    0.175
    0.2 *
    VCCIO
    0.8 *
    VCCIO
    8-8
    SSTL-15
    Class II
    VREF -
    0.1
    VREF +
    0.1
    VREF -
    0.175
    VREF +
    0.175
    0.2 *
    VCCIO
    0.8 *
    VCCIO
    16
    -16
    HSTL-18
    Class I
    —VREF -0.1
    VREF +
    0.1
    VREF -
    0.2
    VREF +
    0.2
    0.4
    VCCIO -
    0.4
    8-8
    HSTL-18
    Class II
    VREF -
    0.1
    VREF +
    0.1
    VREF -
    0.2
    VREF +
    0.2
    0.4
    VCCIO -
    0.4
    16
    -16
    HSTL-15
    Class I
    VREF -
    0.1
    VREF +
    0.1
    VREF -
    0.2
    VREF +
    0.2
    0.4
    VCCIO -
    0.4
    8-8
    HSTL-15
    Class II
    VREF -
    0.1
    VREF +
    0.1
    VREF -
    0.2
    VREF +
    0.2
    0.4
    VCCIO -
    0.4
    16
    -16
    HSTL-12
    Class I
    -0.15
    VREF -
    0.08
    VREF +
    0.08
    VCCIO +
    0.15
    VREF -
    0.15
    VREF +
    0.15
    0.25*
    VCCIO
    0.75*
    VCCIO
    8-8
    HSTL-12
    Class II
    -0.15
    VREF -
    0.08
    VREF +
    0.08
    VCCIO +
    0.15
    VREF -
    0.15
    VREF +
    0.15
    0.25*
    VCCIO
    0.75*
    VCCIO
    16
    -16
    Table 1–20. Differential SSTL I/O Standards
    I/O
    Standard
    VCCIO (V)
    VSWING(DC) (V)
    VX(AC) (V)
    VSWING(AC) (V)
    VOX(AC) (V)
    Min
    Typ
    Max
    Min
    Max
    Min
    Typ
    Max
    Min
    Max
    Min
    Typ
    Max
    SSTL-2
    Class I, II
    2.375
    2.5
    2.625
    0.3
    VCCIO+
    0.6
    VCCIO/2
    - 0.2
    VCCIO/2
    + 0.2
    0.62
    VCCIO
    + 0.6
    VCCIO/2
    - 0.15
    VCCIO/2
    + 0.15
    SSTL-18
    Class I, II
    1.71
    1.8
    1.89
    0.25
    VCCIO+
    0.6
    VCCIO/2
    -
    0.175
    VCCIO/2
    + 0.175
    0.5
    VCCIO
    + 0.6
    VCCIO/2
    -
    0.125
    VCCIO/2
    +
    0.125
    SSTL-15
    Class I, II
    1.425
    1.5
    1.575
    0.2
    VCCIO/2
    0.35
    VCCIO/2
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