參數(shù)資料
型號(hào)： EP2SGX90EF1152C5ES
廠商： Altera
文件頁數(shù)： 793/1486頁
文件大?。?/td> 0K
描述： IC STRATIX II GX 90K 1152-FBGA
標(biāo)準(zhǔn)包裝： 0
系列： Stratix® II GX
LAB/CLB數(shù)： 4548
邏輯元件/單元數(shù)： 90960
RAM 位總計(jì)： 4520448
輸入/輸出數(shù)： 558
電源電壓： 1.15 V ~ 1.25 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 70°C
封裝/外殼： 1152-BBGA
供應(yīng)商設(shè)備封裝： 1152-FBGA（27x27）
配用： 544-1725-ND - PCIE KIT W/S II GX EP2SGX90N
544-1724-ND - SI KIT W/SII GX EP2SGX90N
544-1702-ND - VIDEO KIT W/SII GX EP2SGX90N
其它名稱： 544-1765
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2–20
Altera Corporation
Stratix II GX Device Handbook, Volume 2
October 2007
Transmitter Modules
Figure 2–8. Inter-Transceiver Lines of a Five Transceiver Block Device (2SGX130G)
Note to Figure 2–8:
(1)
The Global Clock line must be driven by an input pin.
Transceiver Clock Distribution
This section describes single-lane, four-lane, and eight-lane
configurations for the high-speed and low-speed transceiver clocks. All
protocol support falls in the single-lane configuration except for the
four-lane and eight-lane PIPE mode and XAUI. The four-lane PIPE mode
uses the four-lane configuration. The eight-lane PIPE mode uses the
eight-lane configuration.
Single Lane
In a single-lane configuration, the PLLs in the central block supply the
high speed clock and the clock generation blocks in each transmitter
channel divides down that clock to the frequency needed to support its
particular data rate. In this configuration, two separate clocks can be
supplied through the central block to provide support for two separate
base frequencies. The transmitter clock generation blocks can divide
those down to create additional frequencies for specific data rate
Transmitter
PLL 0
Transceiver Block 0
4
Receiver
PLLs
Transmitter
PLL 1
From Global Clock
(1)
rx_cruclk
REFCLK0
÷2
REFCLK1
÷2
Transceiver Block 1
Transceiver Block 2
Transceiver Block 3
Transceiver Block 4
To IQ4
To IQ3
To IQ2
To IQ1
To IQ0
IQ[4..0]
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PDF描述
IDT71256SA20PZGI IC SRAM 256KBIT 20NS 28TSOP
IDT71256SA12PZGI IC SRAM 256KBIT 12NS 28TSOP
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EP2SGX90EF1152C4ES IC STRATIX II GX 90K 1152-FBGA
EP2SGX90EF1152C3ES IC STRATIX II GX 90K 1152-FBGA
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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EP2SGX90EF1152I4 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 FPGA - Stratix II GX 4548 LABs 558 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
EP2SGX90EF1152I4N 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 FPGA - Stratix II GX 4548 LABs 558 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
EP2SGX90F 制造商:ALTERA 制造商全稱:Altera Corporation 功能描述:Stratix II GX Device
EP2SGX90FF1508C3 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 FPGA - Stratix II GX 4548 LABs 650 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
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